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参数资料
| 型号： | KSZ8841-16MQL |
| 厂商： | Micrel Inc |
| 文件页数： | 58/105页 |
| 文件大小： | 0K |
| 描述： | IC MAC CTRLR 8/16BIT 128-PQFP |
| 标准包装： | 66 |
| 控制器类型： | 以太网控制器，MAC |
| 接口： | 总线 |
| 电源电压： | 3.1 V ~ 3.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 128-BFQFP |
| 供应商设备封装： | 128-PQFP（14x20） |
| 包装： | 托盘 |
| 产品目录页面： | 1080 (CN2011-ZH PDF) |
| 配用： | 576-1631-ND - BOARD EVALUATION KSZ8841-16MQL |
| 其它名称： | 576-2112 KSZ8841-16MQL-ND |
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Micrel, Inc.
KSZ8841-16/32 MQL/MVL/MBL
October 2007
56
M9999-102207-1.6
Bank 3 Memory BIST Info Register (0x04): MBIR
Bit
Default Value
R/W
Description
15-13
0x0
RO
Reserved.
12
-
RO
TXMBF TX Memory Bist Finish
When set, it indicates the Memory Built In Self Test completion for the TX Memory.
11
-
RO
TXMBFA TX Memory Bist Fail
When set, it indicates the Memory Built In Self Test has failed.
10-5
-
RO
Reserved
4
-
RO
RXMBF RX Memory Bist Finish
When set, it indicates the Memory Built In Self Test completion for the RX Memory.
3
-
RO
RXMBFA RX Memory Bist Fail
When set, it indicates the Memory Built In Self Test has failed.
2-0
-
RO
Reserved.
Bank 3 Global Reset Register (0x06): GRR
This register controls the global reset function with information programmed by the CPU.
Bit
Default Value
R/W
Description
15-1
0x0000
RO
Reserved.
0
RW
Global Soft Reset
= 1 software reset is active.
= 0 software reset is inactive.
Software reset will affect PHY, MAC, QMU, DMA, and the switch core, only the BIU
(base address registers) remains unaffected by a software reset.
Bank 3 Power Management Capabilities Register (0x08): PMCR
This register is a read-only register that provides information on the K8841M power management capabilities. These
bits are automatically downloaded from Configparam word of EEPROM , if pin EEEN is high (enabled EEPROM)
Bit
Default Value
R/W
Description
15
0
RO
PME Support D3 (cold)
This bit defaults to 0, so the KSZ8841M does not support D3(cold)
14
1
RO
PME Support D3 (hot)
This bit is 1 only,it is indicating that the KSZ8841M can assert PME event (PMEN pin
14) in D3(hot) power state.(see bit1:0 in PMCS register)
13
0
RO
PME Support D2
If this bit is set, the wake-up signals will assert PME event (PMEN pin 14) when the
KSZ8841M is in D2 power state and PME_EN (see bit8 in PMCS register) is set.
Otherwise, the KSZ8841M does not assert PME event (PMEN pin 14) when the
KSZ8841M is in D2 power state.
The value of this bit is loaded from the PME_D2 bit of 0x6 in the serial EEPROM
(without an EEPROM, this bit defaults to 0).
12
0
RO
PME Support D1
If this bit is set, the wake-up signals will assert PME event (PMEN pin 14) when the
KSZ8841M is in D1 power state and PME_EN (see bit8 in PMCS register) is set.
Otherwise, the KSZ8841M does not assert PME event (PMEN pin 14) when the
KSZ8841M is in D1 power state.
The value of this bit loaded from the PME_D1 bit of 0x6 in the serial EEPROM (without
an EEPROM, this bit defaults to 0).
11
0
RO
PME Support D0
This bit defaults to 0, it is indicating that the KSZ8841M does not assert PME event
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