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参数资料
| 型号： | LXT384BE |
| 元件分类： | 通信、网络模块及开发工具 |
| 英文描述： | Telecomm/Datacomm |
| 中文描述： | 电信/数据通信 |
| 文件页数： | 40/80页 |
| 文件大小： | 1112K |
| 代理商： | LXT384BE |
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LXT384
—
Octal T1/E1/J1 Transceiver
40
Datasheet
Global Control
Register
GCR
R/W
Reserved
RAISEN
CDIS
CODEN FIFO64
JACF
JASEL1 JASEL0
Pulse Shaping
Indirect Address
Register
PSIAD R/W
Reserved
Reserved
Reserved
Reserved
Reserved
LENAD2 LENAD1 LENAD0
Pulse Shaping
Data Register
PSDAT R/W
Reserved
Reserved
Reserved
Reserved
Reserved
LEN2
LEN1
LEN0
Output Enable
Register
OER
R/W
OE7
OE6
OE5
OE4
OE3
OE2
OE1
OE0
AIS Status
Register
AIS
R
AIS7
AIS6
AIS5
AIS4
AIS3
AIS2
AIS1
AIS0
AIS Interrupt
Enable
AISIE
R/W
AISIE
7 AISIE6 AISIE5 AISIE4
AISIE3
AISIE2
AISIE1
AISIE0
AIS Interrupt
Status
AISIS
R
AISIS7
AISIS6 AISIS5 AISIS4
AISIS3
AISIS2
AISIS1
AISIS0
Table 8. ID Register, ID (00h)
Bit
Name
Function
7-0
ID7-ID0
This register contains a unique revision code and is mask programmed.
For Rev. A4, 00h
For Rev. A5, 15h
Table 9. Analog Loopback Register, ALOOP (01h)
Bit
Name
Function
7-0
AL7-AL0
Setting a bit to
“
1
”
enables analog local loopback for transceivers 7- 0 respectively.
Table 10. Remote Loopback Register, RLOOP (02h)
Bit
Name
Function
7-0
RL7-RL0
Setting a bit to
“
1
”
enables remote loopback for transceivers 7-0 respectively.
Table 11. TAOS Enable Register, TAOS (03h)
Bit
1
Name
Function
2
7-0
TAOS7-TAOS0
Setting a bit to
“
1
”
causes a continuous stream of marks to be sent out at the TTIP and
TRING pins of the respective transceiver 7-0.
1. On power up all register bits are set to
“
0
”
.
2. MCLK is used as timing reference. If MCLK is not available then the channel TCLK is used as the
reference.This feature is not available in data recovery and line driver mode (MCLK= High and TCLK =
High).
Table 7. Register Bit Names (Sheet 2 of 2)
Register
Bit
Name
Sym
RW
7
6
5
4
3
2
1
0
相关PDF资料 |
PDF描述 |
|---|---|
| LXT384LE | Telecomm/Datacomm |
| LXT386BE | PCM TRANSCEIVER|QUAD|CEPT PCM-30/E-1|CMOS|BGA|160PIN|PLASTIC |
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相关代理商/技术参数 |
参数描述 |
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