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参数资料
| 型号： | M306K9F8LRP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | 16 X 16 MM, 0.40 MM PITCH, PLASTIC, TQFP-144 |
| 文件页数： | 12/101页 |
| 文件大小： | 2590K |
| 代理商： | M306K9F8LRP |
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109
XMEGA A3U [DATASHEET]
Atmel-8386D-AVR-ATxmega64A3U-128A3U-192A3U-256A3U–03/2014
36.2.16 Two-Wire Interface Characteristics
Table 36-32 describes the requirements for devices connected to the Two-Wire Interface Bus. The Atmel AVR XMEGA
Two-Wire Interface meets or exceeds these requirements under the noted conditions. Timing symbols refer to Figure 36-
Figure 36-14.Two-wire interface bus timing.
Table 36-64. Two-wire interface characteristics.
tHD;STA
tof
SDA
SCL
tLOW
tHIGH
tSU;STA
tBUF
tr
tHD;DAT
tSU;DAT
tSU;STO
Symbol
Parameter
Condition
Min.
Typ.
Max.
Units
VIH
Input High Voltage
0.7*VCC
VCC+0.5
V
VIL
Input Low Voltage
-0.5
0.3*VCC
V
Vhys
Hysteresis of Schmitt Trigger Inputs
0.05*VCC (1)
0
V
VOL
Output Low Voltage
3mA, sink current
0
0.4
V
tr
Rise Time for both SDA and SCL
20+0.1Cb (1)(2)
0
ns
tof
Output Fall Time from VIHmin to VILmax
20+0.1Cb (1)(2)
300
ns
tSP
Spikes Suppressed by Input Filter
0
50
ns
II
Input Current for each I/O Pin
0.1VCC < VI < 0.9VCC
-10
10
A
CI
Capacitance for each I/O Pin
10
pF
fSCL
SCL Clock Frequency
0
400
kHz
RP
Value of Pull-up resistor
fSCL 100kHz
fSCL > 100kHz
tHD;STA
Hold Time (repeated) START condition
fSCL 100kHz
4.0
s
fSCL > 100kHz
0.6
tLOW
Low Period of SCL Clock
fSCL 100kHz
4.7
s
fSCL > 100kHz
1.3
tHIGH
High Period of SCL Clock
fSCL 100kHz
4.0
s
fSCL > 100kHz
0.6
V
CC
0.4V
–
3mA
----------------------------
100ns
C
b
---------------
300ns
C
b
---------------
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PDF描述 |
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