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参数资料
| 型号： | M34518E8SP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 4-BIT, OTPROM, 6 MHz, MICROCONTROLLER, PDIP32 |
| 封装： | 8.90 X 28 MM, 1.78 MM PITCH, PLASTIC, SDIP-32 |
| 文件页数： | 64/162页 |
| 文件大小： | 1149K |
| 代理商： | M34518E8SP |
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Rev.3.01
2005.06.15
page 154 of 157
REJ03B0008-0301
4518 Group
BASIC TIMING DIAGRAM
VOLTAGE DROP DETECTION CIRCUIT CHARACTERISTICS
(Ta = –20 °C to 85 °C, unless otherwise noted)
Test conditions
Ta = 25 °C
Mask ROM version
One Time PROM version
Ta = 25 °C
Mask ROM version
One Time PROM version
VDD = 5 V
VDD = 3 V
VDD
→ (VRST– – 0.1 V) (Note 4)
Parameter
Detection voltage
(reset occurs) (Note 1)
Detection voltage
(reset release) (Note 2)
Detection voltage hysteresis
Operation current (Note 3)
Detection time
Symbol
VRST–
VRST+
VRST+–
VRST–
IRST
TRST
Limits
Unit
Min.
3.3
2.7
2.6
3.5
2.9
2.8
Typ.
3.5
3.7
0.2
50
30
0.2
Max.
3.7
4.2
3.9
4.4
100
60
1.2
V
A
ms
Notes 1: The detected voltage (VRST–) is defined as the voltage when reset occurs when the supply voltage (VDD) is falling.
2: The detected voltage (VRST+) is defined as the voltage when reset is released when the supply voltage (VDD) is rising from reset occurs.
3: When the voltage drop detection circuit is used (VDCE pin = “H”), IRST is added to IDD (power current).
4: The detection time (TRST) is defined as the time until reset occurs when the supply voltage (VDD) is falling to [VRST– – 0.1 V].
STCK
Parameter
Pin (signal) name
Machine cycle
Mi
Mi+1
D0–D7
System clock
Port D output
Port D input
Ports P0, P1, P2, P3,
P6 output
Ports P0, P1, P2, P3,
P6 input
D0–D7
INT0, INT1
Interrupt input
P00–P03
P10–P13
P00–P03
P10–P13
P20–P23
P30, P31
P20–P23
P30, P31
P60–P63
相关PDF资料 |
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