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参数资料
| 型号： | M34518E8SP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 4-BIT, OTPROM, 6 MHz, MICROCONTROLLER, PDIP32 |
| 封装： | 8.90 X 28 MM, 1.78 MM PITCH, PLASTIC, SDIP-32 |
| 文件页数： | 92/162页 |
| 文件大小： | 1149K |
| 代理商： | M34518E8SP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页当前第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页
Rev.3.01
2005.06.15
page 33 of 157
REJ03B0008-0301
4518 Group
Fig. 26 Timer structure (2)
1 - - - - - - - - - - - - - - 16
Watchdog timer
INSTCK
Q
R
S
WDF1
WRST instruction
Q
R
S
WEF
DWDT instruction
+
WRST instruction
RESET signal
Q
T
D
R
RESET signal
Watchdog reset signal
PWMOUT
0
1
I22
0
1
P31/INT1
W33
T3UDF
I20
I23
I21
W31, W30
10
11
01
00
ORCLK
T2UDF
T3F
(TAB3)
(T3AB)
Timer 3 (8)
Timer 3
interrupt
Reload register R3 (8)
Register B Register A
Timer 3
underflow signal
(T3UDF)
One-sided edge
detection circuit
Both edges
detection circuit
W32
1
0
W63
0
1
I20
S
R
Q
1
0
W43
PWMOD
Q
R
D
T
W32
W61
T3UDF
Port D7 output
D7/CNTR1
Register B Register A
Reload register R4H (8)
(TAB4)
(T4AB)
Timer 4 (8)
Reload register R4L (8)
Register B Register A
Reload control circuit
W41
1
0
W40
1/2
ORCLK
XIN
“H” interval expansion
0
1
W42
T4F
R
Q
T
W43
PWMOUT
(T4HAB)
(T4R4L)
Timer 4
interrupt
(Note 4)
(TR3AB)
(Note 3)
(Note 5)
(Note 6)
TR3AB:
T4R4L:
INSTCK:
ORCLK:
This instruction is used to transfer the contents of
register A and register B to only reload register R3.
This instruction is used to transfer the contents of
reload register R4L to timer 4.
Instruction clock (system clock divided by 3)
Prescaler output (instruction clock divided by 1 to 256)
Data is set automatically from each reload
register when timer underflows
(auto-reload function).
Notes 3: XIN cannot be used for the count source when bit 1 (MR1) of
register MR is set to “1” and f(XIN) oscillation is stopped.
4: Timer 3 count start synchronous circuit is set by the valid edge
of P31/INT1 pin selected by bits 1 (I21) and 2 (I22) of register I2.
5: Flag WDF1 is cleared to “0” and the next instruction is skipped
when the WRST instruction is executed while flag WDF1 = “1”.
The next instruction is not skipped even when the WRST
instruction is executed while flag WDF1 = “0”.
6: Flag WEF is cleared to “0” and watchdog timer reset does not
occur when the DWDT instruction and WRST instruction are
executed continuously.
7: The WEF flag is set to “1” at system reset or RAM back-up
mode.
(Note 7)
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PDF描述 |
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