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参数资料
| 型号： | M37270EF-XXXSP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 8.1 MHz, MICROCONTROLLER, PDIP64 |
| 封装： | 0.750 INCH, 1.78 MM PITCH, PLASTIC, SDIP-64 |
| 文件页数： | 24/97页 |
| 文件大小： | 1359K |
| 代理商： | M37270EF-XXXSP |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页当前第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页
MITSUBISHI MICROCOMPUTERS
M37270MF-XXXSP
M37270EF-XXXSP, M37270EFSP
SINGLE-CHIP 8-BIT CMOS MICROCOMPUTER with CLOSED CAPTION DECODER
and ON-SCREEN DISPLAY CONTROLLER
27
00
0
7
Data slicer control register 1
(DSC1: address 00E A16)
Data slicer control bit
0: Data slicer stopped
1: Data slicer operating
Field to be sliced data selection bit
Fix this bit to “0.”
Data latch completion flag for caption
data in main data slice line
0: Data is not yet latched
1: Data is latched
Field determination flag
00
0
7
Hsep
Vsep
Hsep
Vsep
0 :
1 :
Field of main data
slice line
Field for setting
reference voltage
b2 b1
0 0
F2
0 1
F1
1 0
and F2
1 1
and F2
F2
F1
F2
F1
Definition of fields 1 (F1) and 2 (F2)
Hsep
VSYNC
Vsep
F1 :
Hsep
VSYNC
Vsep
F2 :
F2
F1
F2
F1
0
7
Data slicer control register 3
(DSC3: address 021016)
Line selection bit for slice voltage
0: Main data slice line
1: Sub-data slice line
Field of sub-data
slice line
b2 b1
0 0
F2
0 1
F1
1 0
F1 and F2
1 1
F1 and F2
Field to be sliced data selection bit
Setting bit of sub-data slice line
Field for setting
reference voltage
Fix these bits to “0.”
Data slicer control register 2
(DSC2: address 00E B16)
Timing signal generating circuit
control bit
0: Stopped
1: Operating
Reference clock source selection
bit
0: Video signal
1: HSYNC signal
Test bit: read-only
Fix these bits to “0.”
V-pulse shape determination flag
0: Match
1: Mismatch
Fix this bit to “0.”
Test bit: read-only
Figure 19 shows the structure of the data slicer control registers.
Fig. 20. Structure of data slicer control registers
F1
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PDF描述 |
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参数描述 |
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