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参数资料
| 型号： | M52259EVB |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 41/46页 |
| 文件大小： | 0K |
| 描述： | BOARD EVAL FOR 52259 COLDFIRE V2 |
| 产品培训模块： | ColdFire MCF5225x |
| 标准包装： | 1 |
| 系列： | ColdFire® |
| 类型： | MCU |
| 适用于相关产品： | MCF52259 |
| 所含物品： | 板，线缆，文档，DVD，闪光灯驱动和电源 |
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Electrical Characteristics
Table 28. JTAG and Boundary Scan Timing
Num
J1
J2
J3
J4
J5
J6
J7
J8
J9
J10
J11
J12
J13
J14
Characteristics 1
TCLK frequency of operation
TCLK cycle period
TCLK clock pulse width
TCLK rise and fall times
Boundary scan input data setup time to TCLK rise
Boundary scan input data hold time after TCLK rise
TCLK low to boundary scan output data valid
TCLK low to boundary scan output high Z
TMS, TDI input data setup time to TCLK rise
TMS, TDI Input data hold time after TCLK rise
TCLK low to TDO data valid
TCLK low to TDO high Z
TRST assert time
TRST setup time (negation) to TCLK high
Symbol
f JCYC
t JCYC
t JCW
t JCRF
t BSDST
t BSDHT
t BSDV
t BSDZ
t TAPBST
t TAPBHT
t TDODV
t TDODZ
t TRSTAT
t TRSTST
Min
DC
4 ? t CYC
26
0
4
26
0
0
4
10
0
0
100
10
Max
1/4
—
—
3
—
—
33
33
—
—
26
8
—
—
Unit
f sys/2
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
1
JTAG_EN is expected to be a static signal. Hence, it is not associated with any timing.
J2
J3
J3
TCLK
V IH
(input)
J4
V IL
J4
Figure 16. Test Clock Input Timing
MCF52259 ColdFire Microcontroller, Rev. 5
41
Freescale
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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