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参数资料
| 型号： | M7020R |
| 厂商： | 意法半导体 |
| 英文描述： | 32K x 68-bit Entry NETWORK SEARCH ENGINE |
| 中文描述： | 32K的× 68位进入网络搜索引擎 |
| 文件页数： | 22/150页 |
| 文件大小： | 996K |
| 代理商： | M7020R |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页当前第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页
M7020R
22/150
Comparand Registers
The device contains 32 68-bit comparand regis-
ters (16 pairs) dynamically selected in every
SEARCH operation to store the comparand pre-
sented on the DQ Bus. The LEARN command will
later use these registers when executed. The
M7020R stores the SEARCH command’s Cycle A
comparand in the even-numbered register and the
Cycle B comparand in the odd-numbered register,
as shown in Figure 10.
Mask Registers
The device contains 16 68-bit global mask regis-
ters (8 pairs) dynamically selected in every
SEARCH operation to select the search subfield.
The addressing of these registers is explained in
Figure 11. The three-bit GMR Index supplied on
the CMD bus can apply 8 pairs of global masks
during the SEARCH and WRITE operations, as
shown in Figure 11.
Note:
In 68-bit SEARCH and WRITE operations,
the host ASIC must program both the even and
odd mask registers with the same values.
Each mask bit in the GMRs is used during
SEARCH and WRITE operations. In SEARCH op-
erations, setting the mask bit to '1' enables com-
pares; setting the mask bit to '0' disables
compares (forced match) at the corresponding bit
position. In WRITE operations to the data or mask
array, setting the mask bit to '1' enables WRITEs;
setting the mask bit to '0' disables WRITEs at the
corresponding bit position.
Figure 10. Comparand Register Selection
During SEARCH and LEARN
Instructions
Figure 11. Addressing the Global Masks
Register Array
135
0
68
68
1
3
5
7
0
2
4
6
30
31
0
1
15
Address
Index
AI04275
135
0
68
68
1
3
5
7
9
0
2
4
6
8
11
13
15
10
12
14
0
1
2
3
6
7
5
4
Address
Index
AI04276
SEARCH and WRITE Command
Global Mask Selection
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