参数资料
| 型号： | MAX9856ETL+T |
| 厂商： | Maxim Integrated Products |
| 文件页数： | 19/46页 |
| 文件大小： | 0K |
| 描述： | IC AUDIO CODEC 40TQFN-EP |
| 产品培训模块： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 标准包装： | 2,500 |
| 类型： | 音频编解码器 |
| 数据接口： | 串行 |
| 分辨率（位）： | 18 b |
| ADC / DAC 数量： | 2 / 2 |
| 三角积分调变： | 是 |
| S/N 比，标准 ADC / DAC (db)： | 77 / 91 |
| 动态范围，标准 ADC / DAC (db)： | 85 / 91 |
| 电压 - 电源，模拟： | 1.71 V ~ 3.6 V |
| 电压 - 电源，数字： | 1.71 V ~ 3.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 40-WFQFN 裸露焊盘 |
| 供应商设备封装： | 40-TQFN-EP（5x5） |
| 包装： | 带卷 (TR) |
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MAX9856
Low-Power Audio CODEC with
DirectDrive Headphone Amplifiers
26
______________________________________________________________________________________
REGISTER
FUNCTION
APIN
LRCLK_A/GPIO Configuration:
00 = General-purpose input
01 = Word clock for the ADC
10 = General-purpose output—low
11 = General-purpose output—high
When APIN
≠ 01, LRCLK_D is used as the word clock for both the DAC and ADC. AWCI, ABCI, and
ADLY are still active and independent from the DAC mode bit settings when operating with a shared
LRCLK_D.
ADLY
ADC Data Delay
0—The most significant bit of an audio word is valid at the first BCLK edge after the LRCLK_A
transition.
1—The most significant bit of an audio word is valid at the second BCLK edge after the LRCLK_A
transition.
(ADLY = 1 for I2S-compatible mode)
APLLEN
ADC PLL Enable. This bit only applies when APIN = 01. When APIN
≠ 01 use DPLLEN for both the
DAC and ADC:
0 (Valid for slave and master mode)—The frequency of LRCLK_A is set by the ADCNI divider bits. In
master mode, the MAX9856 generates LRCLK_A using the specified divide ratio. In slave mode, the
MAX9856 expects an LRCLK_A using specified divide ratio.
1 (Valid for slave mode only)—A digital PLL locks on to any externally supplied LRCLK_A signal
regardless of the MCLK frequency.
ADCNI
ADC LRCLK Divider. If APIN
≠ 01, use DACNI for both the DAC and ADC. When APLLEN is set low,
the frequency of LRCLK_A is determined by ADCNI. See Table 6 for common ADCNI values:
ADCNI = (65536 x 96 x fLRCLK_A)/fPCLK.
fLRCLK_A = LRCLK_A frequency.
fPCLK = Prescaled MCLK internal clock frequency (PCLK).
ADC Output Gain. Specifies the gain applied to the digital output of the ADC prior to being output
from the device.
VALUE
GAIN (dB)
0x0
+3
0x1
+2
0x2
+1
0x3
0
0x4
-1
0x5
-2
0x6
-3
0x7
-4
0x8
-5
0x9
-6
0xA
-7
0xB
-8
0xC
-9
0xD
-10
0xE
-11
AGAIN
0xF
-12
ADC Interface Register Bit Description (continued)
相关PDF资料 |
PDF描述 |
|---|---|
| MAX9860ETG+T | IC CODEC MONO AUD 16BIT 24TQFN |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MAX9856EVKIT+ | 功能描述:音频 IC 开发工具 Evaluation Kit for the MAX9856 RoHS:否 制造商:Texas Instruments 产品:Evaluation Kits 类型:Audio Amplifiers 工具用于评估:TAS5614L 工作电源电压:12 V to 38 V |
| MAX9856GTL/V+ | 功能描述:接口—CODEC Low-Power Audio CODEC with DirectDrive Headphone Amplifiers RoHS:否 制造商:Texas Instruments 类型: 分辨率: 转换速率:48 kSPs 接口类型:I2C ADC 数量:2 DAC 数量:4 工作电源电压:1.8 V, 2.1 V, 2.3 V to 5.5 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:DSBGA-81 封装:Reel |
| MAX9856GTL/V+T | 功能描述:接口—CODEC Low-Power Audio CODEC with DirectDrive Headphone Amplifiers RoHS:否 制造商:Texas Instruments 类型: 分辨率: 转换速率:48 kSPs 接口类型:I2C ADC 数量:2 DAC 数量:4 工作电源电压:1.8 V, 2.1 V, 2.3 V to 5.5 V 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:DSBGA-81 封装:Reel |
| MAX985EBT+T | 功能描述:校验器 IC Single uPower Comparator RoHS:否 制造商:STMicroelectronics 产品: 比较器类型: 通道数量: 输出类型:Push-Pull 电源电压-最大:5.5 V 电源电压-最小:1.1 V 补偿电压（最大值）:6 mV 电源电流（最大值）:1350 nA 响应时间: 最大工作温度:+ 125 C 安装风格:SMD/SMT 封装 / 箱体:SC-70-5 封装:Reel |
| MAX985EBT+TG45 | 功能描述:校验器 IC Single uPower Comparator RoHS:否 制造商:STMicroelectronics 产品: 比较器类型: 通道数量: 输出类型:Push-Pull 电源电压-最大:5.5 V 电源电压-最小:1.1 V 补偿电压（最大值）:6 mV 电源电流（最大值）:1350 nA 响应时间: 最大工作温度:+ 125 C 安装风格:SMD/SMT 封装 / 箱体:SC-70-5 封装:Reel |
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