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参数资料
| 型号： | MB90F523PFV-G |
| 厂商： | FUJITSU LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP120 |
| 封装： | PLASTIC, QFP-120 |
| 文件页数： | 11/127页 |
| 文件大小： | 2636K |
| 代理商： | MB90F523PFV-G |
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MB90520 Series
108
Table 4
Number of Execution Cycles for Effective Address in Addressing Modes
Note: (a) is used for ~ (number of cycles) and B (correction value) detailed instruction rules in instruction table.
Table 5
Correction Value for Number of Cycles for Calculating Actual Number of Cycles
Notes: (b), (c), (d) is used for ~ (number of cycles) and B (correction value) in instruction table.
When the external bus is used, cycles for wait insertion for the ready input and automatic ready operation
must be added.
Table 6
Correction Value for Number of Cycles for Calculating Number of Program Fetch Cycles
Notes: When the external bus is used, cycles for wait insertion for the ready input and automatic ready operation
must be added.
Because execution of instruction is not delayed for all program fetch operations, use this value to calculate
the worst case.
Code
Operand
(a)
Number of register
accesses for addressing
modes
Number of execution cycles
for addressing modes
00 to 07
Ri
RWi
RLi
Listed in instruction table
08 to 0B
@RWj
2
1
0C to 0F
@RWj +
4
2
10 to 17
@RWi + disp8
2
1
18 to 1B
@RWj + disp16
2
1
1C
1D
1E
1F
@RW0 + RW7
@RW1 + RW7
@PC + disp16
addr16
4
2
1
2
0
Operand
(b) byte
(c) word
(d) long
Number of
cycles
Number of
access
Number of
cycles
Number of
access
Number of
cycles
Number of
access
Internal register
+01+01+02
Internal memory even address
Internal memory odd address
+0
1
+0
+2
1
2
+0
+4
2
4
External data bus 16-bit even
address
External data bus 16-bit odd
address
+1
1
+1
+4
1
2
+2
+8
2
4
External data bus 8-bit
+11+42+84
Instruction
Byte boundary
Word boundary
Internal memory
—
+2
External data bus 16-bit
—
+3
External data bus 8-bit
+3
—
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