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参数资料
| 型号： | MB90F523PFV-G |
| 厂商： | FUJITSU LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP120 |
| 封装： | PLASTIC, QFP-120 |
| 文件页数： | 86/127页 |
| 文件大小： | 2636K |
| 代理商： | MB90F523PFV-G |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页当前第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页
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MB90520 Series
10. DTP/External Interrupt Circuit
DTP (Data Transfer Peripheral), which is located between the peripheral circuit outside the device and the
F2MC-16LX CPU, receives an interrupt request or DMA request generated by the external peripheral circuit*
for transmission to the F2MC-16LX CPU. DTP is used to activate the intelligent I/O service or interrupt processing.
As request levels, two types of “H” and “L” can be selected for the intelligent I/O service. Rising and falling edges
as well as “H” and “L” can be selected for an external interrupt request.
* : The external peripheral circuit is connected outside the MB90520 series device.
(1) Register Configuration
DTP/interrupt factor register (EIRR)
Address
000031H
bit 7
bit 0
ER7
ER6
ER5
ER4
ER3
ER2
ER1
ER0
bit 15
bit 14
bit 13
bit 12
bit 11
bit 10
bit 9
bit 8
..... .......
(ENIR)
Initial value
XXXXXXXX B
R/W
Address
000030H
bit 15
bit 8
EN7
EN6
EN5
EN4
EN3
EN2
EN1
EN0
(EIRR)
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
..... .......
R/W
Initial value
00 000 00 0 B
Address
Low order address 000032H
bit 15
bit 8
LB3
LA3
LB2
LA2
LB1
LA1
LB0
LA0
(ELVR upper)
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
..... .......
R/W
Initial value
00 000 00 0 B
DTP/interrupt enable register (ENIR)
R/W : Readable and writable
X : Indeterminate
Address
High order address 000033H
LB7
LA7
LB6
LA6
LB5
LA5
LB4
LA4
(ELVR lower)
Initial value
00 000 00 0 B
R/W
Request level setting register (ELVR)
bit 7
bit 0
bit 15
bit 14
bit 13
bit 12
bit 11
bit 10
bit 9
bit 8
..... .......
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