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参数资料
| 型号： | MC56F8002VWL |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 65/106页 |
| 文件大小： | 0K |
| 描述： | DSC 12K FLASH 32MHZ 28-SOIC |
| 标准包装： | 26 |
| 系列： | 56F8xxx |
| 核心处理器： | 56800E |
| 芯体尺寸： | 16-位 |
| 速度： | 32MHz |
| 连通性： | I²C，LIN，SCI，SPI |
| 外围设备： | LVD，POR，PWM，WDT |
| 输入/输出数： | 23 |
| 程序存储器容量： | 12KB（6K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1K x 16 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 数据转换器： | A/D 15x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 28-SOIC（0.295"，7.50mm 宽） |
| 包装： | 管件 |
| 产品目录页面： | 734 (CN2011-ZH PDF) |
| 配用： | APMOTOR56F8000E-ND - KIT DEMO MOTOR CTRL SYSTEM |
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Specifications
MC56F8006/MC56F8002 Digital Signal Controller, Rev. 4
Freescale Semiconductor
61
Figure 30. SPI Slave Timing (CPHA = 1)
8.13.2
Serial Communication Interface (SCI) Timing
Table 30. SCI Timing1
1 Parameters listed are guaranteed by design.
Characteristic
Symbol
Min
Max
Unit
See Figure
Baud rate2
2 f
MAX is the frequency of operation of the SCI in MHz, which can be selected system clock (max. 32 MHz) or 3x system clock
(max. 96 MHz) for the 56F8006/56F8002 device.
BR
—
(fMAX/16)
Mbps
—
RXD pulse width
RXDPW
0.965/BR
1.04/BR
ns
TXD pulse width
TXDPW
0.965/BR
1.04/BR
ns
LIN Slave Mode
Deviation of slave node clock from
nominal clock rate before
synchronization
FTOL_UNSYNCH
–14
14
%
—
Deviation of slave node clock relative to
the master node clock after
synchronization
FTOL_SYNCH
–2
2
%
—
Minimum break character length
TBREAK
13
—
Master node
bit periods
—
11
—
Slave node
bit periods
—
SCLK (CPOL = 0)
(Input)
SCLK (CPOL = 1)
(Input)
MISO
(Output)
MOSI
(Input)
Slave MSB out
Bits 14–1
tC
tCL
tCH
tDI
MSB in
Bits 14–1
LSB in
SS
(Input)
tCH
tDH
tF
tR
Slave LSB out
tD
tA
tELD
tDV
tF
tR
tELG
tDV
tDS
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