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参数资料
| 型号： | MC56F8002VWL |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 69/106页 |
| 文件大小： | 0K |
| 描述： | DSC 12K FLASH 32MHZ 28-SOIC |
| 标准包装： | 26 |
| 系列： | 56F8xxx |
| 核心处理器： | 56800E |
| 芯体尺寸： | 16-位 |
| 速度： | 32MHz |
| 连通性： | I²C，LIN，SCI，SPI |
| 外围设备： | LVD，POR，PWM，WDT |
| 输入/输出数： | 23 |
| 程序存储器容量： | 12KB（6K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1K x 16 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 数据转换器： | A/D 15x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 28-SOIC（0.295"，7.50mm 宽） |
| 包装： | 管件 |
| 产品目录页面： | 734 (CN2011-ZH PDF) |
| 配用： | APMOTOR56F8000E-ND - KIT DEMO MOTOR CTRL SYSTEM |
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Specifications
MC56F8006/MC56F8002 Digital Signal Controller, Rev. 4
Freescale Semiconductor
65
8.14
COP Specifications
8.15
PGA Specifications
Table 34. COP Specifications
Parameter
Symbol
Min
Typ
Max
Unit
Oscillator output frequency
LPFosc
500
1000
1500
Hz
Oscillator current consumption in partial power down mode
IDD
TBD
nA
Table 35. PGA Specifications
Parameter
Symbol
Min
Max
Unit
Digital logic inputs amplitude (_2p5 signal)
V2p5
2.75
V
DC analog input level (@ VDD = avdd3p3)
PGA S/H stage enabled (BP=0)
PGA S/H stage disabled (BP=1)
VIL
0
VDD
VDD – 0.5
V
Max differential input voltage (@ Gain and VDD = avdd3p3)
VDIFFMAX
(VDD – 1) x 0.5/gain
V
Linearity (@ voltage gain)
1x
2x
4x
8x
16x
32x
LV
1 – 1/2 LSB
2 – 1/2 LSB
4 – 1 LSB
8 – 1 LSB
16 – 4 LSB
32 – 4 LSB
1 + 1/2 LSB
2 + 1/2 LSB
4 + 1 LSB
8 + 1 LSB
16 + 4 LSB
32 + 4 LSB
V/V
Gain error (@ voltage gain)
1x
2x
4x
8x
16x
32x
AV
1%
V/V
Sampling frequency (pga_clk_2p5)
normal mode (pga_lp_2p5 asserted)
low power mode (pga_lp_2p5 negated)
SFmax
8
4
MHz
Input signal bandwidth
Motor Control mode (BP=0)
General Purpose mode (BP=1)
BWmax
PGA sampling rate/2
PGA sampling rate/8
Hz
Internal voltage doubler clock frequency(pga_clk_doubler_2p5)
VDclk
100
2000
kHz
Operating temperature
T
–40
125
oC
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参数描述 |
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