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参数资料
| 型号： | MC56F8036VLF |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 50/164页 |
| 文件大小： | 0K |
| 描述： | IC DGTL SGNL CTLR 16BIT 48-LQFP |
| 标准包装： | 1,250 |
| 系列： | 56F8xxx |
| 核心处理器： | 56800E |
| 芯体尺寸： | 16-位 |
| 速度： | 32MHz |
| 连通性： | CAN，I²C，SCI，SPI |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 39 |
| 程序存储器容量： | 64KB（32K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 4K x 16 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 10x12b; D/A 2x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 48-LQFP |
| 包装： | 托盘 |
| 产品目录页面： | 734 (CN2011-ZH PDF) |
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Equivalent Circuit for ADC Inputs
56F8036 Data Sheet, Rev. 6
Freescale Semiconductor
143
10.16 Equivalent Circuit for ADC Inputs
Figure 10-18 illustrates the ADC input circuit during sample and hold. S1 and S2 are always open/closed
at the same time that S3 is closed/open. When S1/S2 are closed and S3 is open, one input of the sample
and hold circuit moves to (VREFHx - VREFLx) / 2, while the other charges to the analog input voltage. When
the switches are flipped, the charge on C1 and C2 are averaged via S3, with the result that a single-ended
analog input is switched to a differential voltage centered about (VREFHx - VREFLx) / 2. The switches
switch on every cycle of the ADC clock (open one-half ADC clock, closed one-half ADC clock). Note that
there are additional capacitances associated with the analog input pad, routing, etc., but these do not filter
into the S/H output voltage, as S1 provides isolation during the charge-sharing phase.
One aspect of this circuit is that there is an on-going input current, which is a function of the analog input
voltage, VREF, and the ADC clock frequency.
1.
Parasitic capacitance due to package, pin-to-pin and pin-to-package base coupling; 1.8pF
2.
Parasitic capacitance due to the chip bond pad, ESD protection devices and signal routing; 2.04pF
3.
Equivalent resistance for the channel select mux; 100 ohms
4.
Sampling capacitor at the sample and hold circuit. Capacitor C1 is normally disconnected from the input and is only
connected to it at sampling time; 1.4pF
Figure 10-18 Equivalent Circuit for A/D Loading
10.17 Comparator (CMP) Parameters
Table 10-21 CMP Parameters
Characteristic
Conditions/Comments
Symbol
Min
Typ
Max
Unit
Input Offset Voltage1
1. No guaranteed specification within 0.1V of VDDA or VSSA
Within range of VDDA - .1V to
VSSA + .1V
VOFFSET
—±10
±35
mV
Input Propagation Delay
tPD
—35
45
ns
Power-up time
tCPU
—TBD
TBD
1
2
3
Analog Input
4
S1
S2
S3
C1
C2
S/H
C1 = C2 = 1pF
(VREFHx - VREFLx ) / 2
125
Ω ESD Resistor
8pF noise damping capacitor
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
|---|---|
| MC56F8036VLF | 制造商:Freescale Semiconductor 功能描述:IC DSC 64KB 32MHZ 3.6V LQFP-48 |
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