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参数资料
| 型号： | MC56F8036VLF |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 84/164页 |
| 文件大小： | 0K |
| 描述： | IC DGTL SGNL CTLR 16BIT 48-LQFP |
| 标准包装： | 1,250 |
| 系列： | 56F8xxx |
| 核心处理器： | 56800E |
| 芯体尺寸： | 16-位 |
| 速度： | 32MHz |
| 连通性： | CAN，I²C，SCI，SPI |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 39 |
| 程序存储器容量： | 64KB（32K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 4K x 16 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 10x12b; D/A 2x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 105°C |
| 封装/外壳： | 48-LQFP |
| 包装： | 托盘 |
| 产品目录页面： | 734 (CN2011-ZH PDF) |
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56F8036 Data Sheet, Rev. 6
26
Freescale Semiconductor
GPIOB2
(MISO0)
(TA27)
(PSRC0)
25
Input/
Output
Input/
Output
Input/
Output
Input
Input,
internal
pull-up
enabled
Port B GPIO — This GPIO pin can be individually programmed as
an input or output pin.
QSPI0 Master In/Slave Out — This serial data pin is an input to a
master device and an output from a slave device. The MISO line of a
slave device is placed in the high-impedance state if the slave device
is not selected. The slave device places data on the MISO line a
half-cycle before the clock edge the master device uses to latch the
data.
TA2 — Timer A, Channel 2
PSRC0 — External PWM signal source input for the complementary
PWM4/PWM5 pair.
After reset, the default state is GPIOB2. The peripheral functionality
is controlled via the SIM. See Section 6.3.16.
7The TA2 signal is also brought out on the GPIOA4 and GPIOA8 pins.
GPIOB3
(MOSI0)
(TA38)
(PSRC1)
24
Input/
Output
Input/
Output
Input/
Output
Input
Input,
internal
pull-up
enabled
Port B GPIO — This GPIO pin can be individually programmed as
an input or output pin.
QSPI0 Master Out/Slave In— This serial data pin is an output from
a master device and an input to a slave device. The master device
places data on the MOSI line a half-cycle before the clock edge the
slave device uses to latch the data.
TA3 — Timer A, Channel 3
PSRC1 — External PWM signal source input for the complementary
PWM2/PWM3 pair.
After reset, the default state is GPIOB3. The peripheral functionality
is controlled via the SIM. See Section 6.3.16.
8The TA3 signal is also brought out on the GPIOA5 and GPIOA9 pins.
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Table 2-3 56F8036 Signal and Package Information for the 48-Pin LQFP (Continued)
Signal
Name
LQFP
Pin No.
Type
State During
Reset
Signal Description
相关PDF资料 |
PDF描述 |
|---|---|
| MC56F8037VLH | IC DSP 16BIT DUAL 64-LQFP |
| MC56F8135VFGE | IC DIGITAL SIGNAL CTLR 128-LQFP |
| MC56F8147VPYE | IC DSP 16BIT 40MHZ 160-LQFP |
| MC56F8155VFGE | IC DSP 16BIT 40MHZ 128-LQFP |
| MC56F8156VFVE | IC DSP 16BIT 40MHZ 144-LQFP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| MC56F8036VLF | 制造商:Freescale Semiconductor 功能描述:IC DSC 64KB 32MHZ 3.6V LQFP-48 |
| MC56F8037 | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:16-bit Digital Signal Controllers |
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