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参数资料
| 型号： | MC68302FC20CR2 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 4 CHANNEL(S), 10M bps, LOCAL AREA NETWORK CONTROLLER, PQFP132 |
| 封装： | 0.950 X 0.950 INCH, 0.025 INCH PITCH, PLASTIC, QFP-132 |
| 文件页数： | 58/128页 |
| 文件大小： | 641K |
| 代理商： | MC68302FC20CR2 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页当前第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页
MC68EN302 DRAM Control Module
3-4
MC68EN302 REFERENCE MANUAL
MOTOROLA
3.6.2 Read and Write Cycle Operation
Figure 3-1 shows two consecutive 4-clock accesses with a 2-clock precharge of RAS. RAS
is negated one clock before CAS to provide a longer precharge time between consecutive
hits in a given bank.
Figure 3-1. Consecutive Four-Clock Accesses
In some cases, a DRAM access is not possible in a 4-clock cycle. In still other cases, the
precharge time of 2 clocks is not enough for the given DRAM. Figure 3-2 shows two
consecutive 5-clock accesses, with a 3-clock RAS precharge. Note that the DRAM signals
are delayed in the second cycle with respect to the processor bus signals, allowing a longer
RAS precharge time.
S2
S3 S4 S5 S6
S1
CLOCK
S0
S7 S0 S1 S2 S3
ADDR
RAS
CAS
DRAMRW
DATA/
AS
UDS/LDS
S4 S5 S6 S7
AMUX
S0
PARITY
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PDF描述 |
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