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参数资料
| 型号： | MC68HC05T7B |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | SDIP-56 |
| 文件页数： | 69/109页 |
| 文件大小： | 9008K |
| 代理商： | MC68HC05T7B |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页当前第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页
Central Processor Unit (CPU)
Instruction Set
MC68HC705KJ1MC68HRC705KJ1MC68HLC705KJ1 — Rev. 3.0
Technical Data
MOTOROLA
Central Processor Unit (CPU)
59
BIH rel
Branch if IRQ Pin High
PC
← (PC) + 2 + rel ? IRQ = 1 —— —— —
REL
2F
rr
3
BIL rel
Branch if IRQ Pin Low
PC
← (PC) + 2 + rel ? IRQ = 0 —— —— —
REL
2E
rr
3
BIT #opr
BIT opr
BIT opr,X
BIT ,X
Bit Test Accumulator with Memory Byte
(A)
∧ (M)
——
—
IMM
DIR
EXT
IX2
IX1
IX
A5
B5
C5
D5
E5
F5
ii
dd
hh ll
ee ff
ff
2
3
4
5
4
3
BLO rel
Branch if Lower (Same as BCS)
PC
← (PC) + 2 + rel ? C = 1
—— —— —
REL
25
rr
3
BLS rel
Branch if Lower or Same
PC
← (PC) + 2 + rel ? C ∨ Z = 1 —— —— —
REL
23
rr
3
BMC rel
Branch if Interrupt Mask Clear
PC
← (PC) + 2 + rel ? I = 0
—— —— —
REL
2C
rr
3
BMI rel
Branch if Minus
PC
← (PC) + 2 + rel ? N = 1
—— —— —
REL
2B
rr
3
BMS rel
Branch if Interrupt Mask Set
PC
← (PC) + 2 + rel ? I = 1
—— —— —
REL
2D
rr
3
BNE rel
Branch if Not Equal
PC
← (PC) + 2 + rel ? Z = 0
—— —— —
REL
26
rr
3
BPL rel
Branch if Plus
PC
← (PC) + 2 + rel ? N = 0
—— —— —
REL
2A
rr
3
BRA rel
Branch Always
PC
← (PC) + 2 + rel ? 1 = 1
—— —— —
REL
20
rr
3
BRCLR n opr rel Branch if Bit n Clear
PC
← (PC) + 2 + rel ? Mn = 0
—— ——
DIR (b0)
DIR (b1)
DIR (b2)
DIR (b3)
DIR (b4)
DIR (b5)
DIR (b6)
DIR (b7)
01
03
05
07
09
0B
0D
0F
dd rr
5
BRN rel
Branch Never
PC
← (PC) + 2 + rel ? 1 = 0
—— —— —
REL
21
rr
3
BRSET n opr rel Branch if Bit n Set
PC
← (PC) + 2 + rel ? Mn = 1
—— ——
DIR (b0)
DIR (b1)
DIR (b2)
DIR (b3)
DIR (b4)
DIR (b5)
DIR (b6)
DIR (b7)
00
02
04
06
08
0A
0C
0E
dd rr
5
BSET n opr
Set Bit n
Mn
← 1
—— —— —
DIR (b0)
DIR (b1)
DIR (b2)
DIR (b3)
DIR (b4)
DIR (b5)
DIR (b6)
DIR (b7)
10
12
14
16
18
1A
1C
1E
dd
5
BSR rel
Branch to Subroutine
PC
← (PC) + 2; push (PCL)
SP
← (SP) – 1; push (PCH)
SP
← (SP) – 1
PC
← (PC) + rel
—— —— —
REL
AD
rr
6
CLC
Clear Carry Bit
C
← 0
—— —— 0INH
98
2
CLI
Clear Interrupt Mask
I
← 0
— 0 —— —
INH
9A
2
Table 4-6. Instruction Set Summary (Sheet 2 of 6)
Source
Form
Operation
Description
Effect
on CCR
Ad
d
ress
M
ode
Op
cod
e
Ope
rand
Cycl
es
HIN Z C
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PDF描述 |
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