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参数资料
| 型号： | MC68HC05T7B |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDIP56 |
| 封装： | SDIP-56 |
| 文件页数： | 72/109页 |
| 文件大小： | 9008K |
| 代理商： | MC68HC05T7B |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页当前第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页
Technical Data
MC68HC705KJ1MC68HRC705KJ1MC68HLC705KJ1 — Rev. 3.0
62
Central Processor Unit (CPU)
MOTOROLA
Central Processor Unit (CPU)
ROR opr
RORA
RORX
ROR opr,X
ROR ,X
Rotate Byte Right through Carry Bit
——
DIR
INH
IX1
IX
36
46
56
66
76
dd
ff
5
3
6
5
RSP
Reset Stack Pointer
SP
← $00FF
—— —— —
INH
9C
2
RTI
Return from Interrupt
SP
← (SP) + 1; Pull (CCR)
SP
← (SP) + 1; Pull (A)
SP
← (SP) + 1; Pull (X)
SP
← (SP) + 1; Pull (PCH)
SP
← (SP) + 1; Pull (PCL)
INH
80
9
RTS
Return from Subroutine
SP
← (SP) + 1; Pull (PCH)
SP
← (SP) + 1; Pull (PCL)
—— —— —
INH
81
6
SBC #opr
SBC opr
SBC opr,X
SBC ,X
Subtract Memory Byte and Carry Bit from
Accumulator
A
← (A) – (M) – (C)
——
IMM
DIR
EXT
IX2
IX1
IX
A2
B2
C2
D2
E2
F2
ii
dd
hh ll
ee ff
ff
2
3
4
5
4
3
SEC
Set Carry Bit
C
← 1
—— —— 1INH
99
2
SEI
Set Interrupt Mask
I
← 1
— 1 —— —
INH
9B
2
STA opr
STA opr,X
STA ,X
Store Accumulator in Memory
M
← (A)
——
—
DIR
EXT
IX2
IX1
IX
B7
C7
D7
E7
F7
dd
hh ll
ee ff
ff
4
5
6
5
4
STOP
Stop Oscillator and Enable IRQ Pin
— 0 —— —
INH
8E
2
STX opr
STX opr,X
STX ,X
Store Index Register In Memory
M
← (X)
——
—
DIR
EXT
IX2
IX1
IX
BF
CF
DF
EF
FF
dd
hh ll
ee ff
ff
4
5
6
5
4
SUB #opr
SUB opr
SUB opr,X
SUB ,X
Subtract Memory Byte from Accumulator
A
← (A) – (M)
——
IMM
DIR
EXT
IX2
IX1
IX
A0
B0
C0
D0
E0
F0
ii
dd
hh ll
ee ff
ff
2
3
4
5
4
3
SWI
Software Interrupt
PC
← (PC) + 1; Push (PCL)
SP
← (SP) – 1; Push (PCH)
SP
← (SP) – 1; Push (X)
SP
← (SP) – 1; Push (A)
SP
← (SP) – 1; Push (CCR)
SP
← (SP) – 1; I ← 1
PCH
← Interrupt Vector High Byte
PCL
← Interrupt Vector Low Byte
— 1 —— —
INH
83
1
0
TAX
Transfer Accumulator to Index Register
X
← (A)
—— —— —
INH
97
2
Table 4-6. Instruction Set Summary (Sheet 5 of 6)
Source
Form
Operation
Description
Effect
on CCR
Ad
d
ress
M
ode
Op
cod
e
Ope
rand
Cycl
es
HIN Z C
b0
b7
C
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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