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参数资料
| 型号： | MC68HC705CL16 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 1.802 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | TQFP-100 |
| 文件页数： | 109/145页 |
| 文件大小： | 673K |
| 代理商： | MC68HC705CL16 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页当前第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页
GENERAL RELEASE SPECIFICATION
June 11, 1997
MOTOROLA
TIMER
MC68HC05CL48
8-14
REV 2.0
The counter alternate register at address $1B and $1C contains the same value
as the free-running counter (at address $19 and $1A); therefore, this alternate
register can be read at any time without affecting the timer overow ag in the
timer status register.
8.1.6 Timer Pin Conguration Register (TIMCONF)
The timer pin conguration register is a read/write register, this is used to control
PTC[6:7] pin function.
CONF7- Pin conguration 7
1 =
Congures PTC7 as timer input capture pin.
0 =
PTC7 used as normal I/O port pin.
CONF6- Pin conguration 6
1 =
Congures PTC6 as timer input capture pin.
0 =
PTC6 used as normal I/O port pin.
8.1.7 Operation During Low Power Mode
During the wait and stop modes, the timer stops and holds at its current state,
retaining all data, and resumes operation from this point when external interrupt
(IRQ), or internal interrupt is received.
8.2
CORE TIMER
The MC68HC05CL48 Core Timer (or Ctimer) for is a 15-stage multi-functional
ripple counter. The features include Timer Over Flow, Power-On Reset (POR),
Real Time Interrupt, and COP Watchdog Timer.
As seen in Figure 8-6, the Timer is driven by the internal bus clock divided by four
with a xed prescaler. This signal drives an 8-bit ripple counter. The value of this
8-bit ripple counter can be read by the CPU at any time by accessing the Ctimer
Counter Register (CTCR) at address $09. A timer overow function is
implemented on the last stage of this counter, giving a possible interrupt at the
rate of E/1024. One additional stages produce the POR function at E/2064. The
Timer Counter Bypass circuitry (available only in Test Mode) is at this point in the
76543210
TIMCONF
$0006
READ
CONF7
CONF6
WRITE
RESET
0
UUUUU
0
U = UNAFFECTED
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PDF描述 |
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