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参数资料
| 型号： | MC68HC705CL16 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 1.802 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | TQFP-100 |
| 文件页数： | 33/145页 |
| 文件大小： | 673K |
| 代理商： | MC68HC705CL16 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页当前第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页
GENERAL RELEASE SPECIFICATION
June 11, 1997
MOTOROLA
ELECTRICAL SPECIFICATIONS
MC68HC05CL48
15-4
REV 2.0
Note: The above IDD measurements include the 32kHz oscillator IDD congured as in Figure 1-4 (a) except for
case (h) and (i).
15.5
CONTROL TIMING
(VDD = 3.3 VDC ±10%, VSS = 0 VDC, TA = –10°C to +70°C, unless otherwise noted)
Notes:
(1) The minimum period tILIL should not be less than the number of cycle times it takes to execute the interrupt
service routine plus 21 tCYC.
15.6
ESD PROTECTION
All pads are designed to withstand 2kV of ESD.
Data
Retention
(i)
VDD=2.0, RESETB = “0”
No Oscillator
IDD
55
A
Start Up
(j)
VDD= 0 to 3V, RESETB = “0”
IDD
3.0
mA
CHARACTERISTIC
Symbol
Min
Max
Unit
Frequency of operation
Crystal option
External clock
fOSC
fIN
32.768
—
32.768
—
kHz
MHz
Internal operating frequency
Crystal option
External clock
fOP
0.016384
—
1.802
—
MHz
Cycle time
tCYC
61035
555
ns
Crystal Oscillator Start-up time. (Refer to Figure 1-4 (a))
“From supply=Vdd to the end of POR cycles.”
tOXOV
—3
s
Crystal Oscillator Start-up Voltage
tOXOV
2.7
5.0
Volts
Crystal Oscillator Small Signal Voltage Gain
AV
10
25
Stop recovery Start-up time (crystal oscillator + POR cycles)
tILCH
—70
ms
PLL lock time (after asserting PON-bit)
tPLL
—10
ms
RESET pulse width
tRL
1.5
IOUT
tCYC
Interrupt pulse width (Edge triggered)
tILIH
119
IIN
ns
Interrupt pulse period
tILIL
See note1
—
tCYC
OSC1 Pulse Width
t
270
280
ns
Mode
Conditions
Symbol
Max
(HC705CL48)
Max
(HC05CL48)
Unit
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PDF描述 |
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