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参数资料
| 型号： | MC68HC705CL16 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 1.802 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | TQFP-100 |
| 文件页数： | 115/145页 |
| 文件大小： | 673K |
| 代理商： | MC68HC705CL16 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页当前第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页
June 11, 1997
GENERAL RELEASE SPECIFICATION
MC68HC05CL48
TIMER
MOTOROLA
REV 2.0
8-19
8.3
ONE SECOND WATCH TIMER
The 1 second Watch Timer is a 15-bit free running counter which runs off the
32kHz external clock directly and is therefore not affected by Stop Mode or Wait
Mode. The Watch Timer is used to generate interrupts at 1 second interval to
wake up the CPU when the I-bit in the CCR is cleared. See Figure 8-7. The Watch
Timer overow ag WTOF is set when the a transition from $7FFF to $0000
occurs and will cause an interrupt if the WTOIE-bit of the Watch Timer control and
status register (WTCSR $0023) is set to ‘1’. This ag is latched and should be
cleared by the Watch Timer interrupt service routine to prevent unwanted
interrupts. Writing a ‘0’ to the WTOF-bit or reset clears the WTOF-bit.
Power on or external reset has no effect on the free running counter and therefore
the counter state is unknown after reset. However, the Watch Timer can be reset
to a known state by writing a ‘1’ to the WTR-bit in the Watch Timer control and
status register. The WTOF ag is prevented from being set during software reset.
Reading the WTR-bit will always return a ‘0’.
The Watch Timer can be disabled by writing a ‘1’ to the WTOFF-bit of the Watch
Timer control and status register, the value of the Watch Timer is retained during
the off period.
Table 8-2. RTI and COP Rates 17.5kHz Bus Frequency
BUS FREQUENCY = 17.5 kHz
RT1:RT0
Div. Ratio
RTI Rate
COP Rate (RTIx7)
00
214
0.94 s
6.58 s
01
215
1.88 s
13.16 s
10
216
3.76 s
26.32 s
11
217
7.52 s
52.64 s
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PDF描述 |
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