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参数资料
| 型号： | MC68HC705JJ7S |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, UVPROM, 2.1 MHz, MICROCONTROLLER, CDIP20 |
| 封装： | WINDOWED, CERAMIC, DIP-20 |
| 文件页数： | 131/164页 |
| 文件大小： | 1165K |
| 代理商： | MC68HC705JJ7S |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页当前第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页
Port Transitions
MC68HC705JJ7 MC68HC705JP7 Advance Information Data Sheet, Rev. 4.1
Freescale Semiconductor
69
7.5 Port Transitions
Glitches and temporary floating inputs can occur if the control bits regarding each port I/O pin are not
performed in the correct sequence.
Do not use read-modify-write instructions on pulldown register A or B.
Avoid glitches on port pins by writing to the port data register before changing data direction
register bits from a logic 0 to a logic 1.
Avoid a floating port input by clearing its pulldown register bit before changing its data direction
register bit from a logic 1 to a logic 0.
The SWPDI bit in the MOR turns off all port pulldown devices and disables software control of the
pulldown devices. Reset has no effect on the pulldown devices when the SWPDI bit is set.
Two or more output pins of the same port can be connected electrically to provide output currents
up to the sum of the maximum specified drive currents as defined in 15.7 DC Electrical
Characteristics (5.0 Vdc) and 15.8 DC Electrical Characteristics (3.0 Vdc). Care must be taken to
ensure that all ganged pins always maintain the same output logic value.
Table 7-4. Port C Pin Functions (28-Pin Versions Only)
Port C
Pin(s)
Control Bits
PORTC Access
(Pin or Data Register)
Result on
Port C Pins
SWPDI
in MOR
Port C
PDICH
PDICL
DDRCx(1)
1. DDRC can always be read or written.
Read
Write
Pulldown
Pin
PC0
PC1
PC2
PC3
0
X(2)
2. Don’t care
00
Pin
Data
On
PCx in
0
X(2)
1
0
Pin
Data
Off
PCx in
1X
X(2)
0
Pin
Data
Off
PCx in
X(2)
1
Data
Off
PCx out
PC4
PC5
PC6
PC7
00
X(2)
0
Pin
Data
On
PCx in
01
X(2)
0
Pin
Data
Off
PCx in
1X
X(2)
0
Pin
Data
Off
PCx in
X(2)
1
Data
Off
PCx out
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