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参数资料
| 型号： | MC68HC705JJ7S |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, UVPROM, 2.1 MHz, MICROCONTROLLER, CDIP20 |
| 封装： | WINDOWED, CERAMIC, DIP-20 |
| 文件页数： | 40/164页 |
| 文件大小： | 1165K |
| 代理商： | MC68HC705JJ7S |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页当前第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页
Instruction Set
MC68HC705JJ7 MC68HC705JP7 Advance Information Data Sheet, Rev. 4.1
134
Freescale Semiconductor
JSR opr
JSR opr,X
JSR ,X
Jump to Subroutine
PC
← (PC) + n (n = 1, 2, or 3)
Push (PCL); SP
← (SP) – 1
Push (PCH); SP
← (SP) – 1
PC
← Conditional Address
— ————
DIR
EXT
IX2
IX1
IX
BD
CD
DD
ED
FD
dd
hh ll
ee ff
ff
5
6
7
6
5
LDA #opr
LDA opr
LDA opr,X
LDA ,X
Load Accumulator with
Memory Byte
A
← (M)
— —
—
IMM
DIR
EXT
IX2
IX1
IX
A6
B6
C6
D6
E6
F6
ii
dd
hh ll
ee ff
ff
2
3
4
5
4
3
LDX #opr
LDX opr
LDX opr,X
LDX ,X
Load Index Register
with Memory Byte
X
← (M)
— —
—
IMM
DIR
EXT
IX2
IX1
IX
AE
BE
CE
DE
EE
FE
ii
dd
hh ll
ee ff
ff
2
3
4
5
4
3
LSL opr
LSLA
LSLX
LSL opr,X
LSL ,X
Logical Shift Left
(Same as ASL)
——
DIR
INH
IX1
IX
38
48
58
68
78
dd
ff
5
3
6
5
LSR opr
LSRA
LSRX
LSR opr,X
LSR ,X
Logical Shift Right
— — 0
DIR
INH
IX1
IX
34
44
54
64
74
dd
ff
5
3
6
5
MUL
Unsigned Multiply
X : A
← (X) × (A)
0 — — — 0
INH
42
11
NEG opr
NEGA
NEGX
NEG opr,X
NEG ,X
Negate Byte
(Two’s Complement)
M
← –(M) = $00 – (M)
A
← –(A) = $00 – (A)
X
← –(X) = $00 – (X)
M
← –(M) = $00 – (M)
M
← –(M) = $00 – (M)
——
DIR
INH
IX1
IX
30
40
50
60
70
ii
ff
5
3
6
5
NOP
No Operation
— ————
INH
9D
2
ORA #opr
ORA opr
ORA opr,X
ORA ,X
Logical OR
Accumulator with
Memory
A
← (A) ∨ (M)
— —
—
IMM
DIR
EXT
IX2
IX1
IX
AA
BA
CA
DA
EA
FA
ii
dd
hh ll
ee ff
ff
2
3
4
5
4
3
ROL opr
ROLA
ROLX
ROL opr,X
ROL ,X
Rotate Byte Left
through Carry Bit
——
DIR
INH
IX1
IX
39
49
59
69
79
dd
ff
5
3
6
5
Table 14-6. Instruction Set Summary (Sheet 4 of 6)
Source
Form
Operation
Description
Effect
on CCR
Addres
s
Mo
de
Op
co
de
Op
erand
Cycles
HIN Z C
C
b0
b7
0
b0
b7
C
0
C
b0
b7
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PDF描述 |
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