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参数资料
| 型号： | MC68HC705JJ7S |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, UVPROM, 2.1 MHz, MICROCONTROLLER, CDIP20 |
| 封装： | WINDOWED, CERAMIC, DIP-20 |
| 文件页数： | 25/164页 |
| 文件大小： | 1165K |
| 代理商： | MC68HC705JJ7S |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页当前第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页
EPROM/OTPROM
MC68HC705JJ7 MC68HC705JP7 Advance Information Data Sheet, Rev. 4.1
120
Freescale Semiconductor
ELAT — EPROM Bus Latch Bit
This read/write bit configures address and data buses for programming the EPROM array. EPROM
data cannot be read when ELAT is set. Clearing the ELAT bit also clears the EPGM bit. Reset clears
ELAT.
1 = Address and data buses configured for EPROM programming of the array. The address and
data buses are latched in the EPROM array when a subsequent write to the array is made. Data
in the EPROM array cannot be read.
0 = Address and data buses configured for normal operation
Whenever the ELAT bit is cleared, the EPGM bit is also cleared. Both the EPGM and the ELAT bit cannot
be set using the same write instruction. Any attempt to set both the ELAT and EPGM bit on the same write
instruction cycle will result in the ELAT bit being set and the EPGM bit being cleared. To program a byte
of EPROM, manipulate the EPROG register as follows:
1.
Set the ELAT bit in the EPROG register.
2.
Write the desired data to the desired EPROM address.
3.
Set the EPGM bit in the EPROG register for the specified programming time, tEPGM.
4.
Clear the ELAT and EPGM bits in the EPROG register.
13.2.2 Mask Option Register
The mask option register (MOR) shown in Figure 13-2 is an EPROM byte that controls eight mask options.
The MOR is unaffected by reset. The erased state of the MOR is $00. The options that can be
programmed by the MOR are:
1.
Port software programmable pulldown devices (enable or disable)
2.
Startup delay after stop (16 or 4064 cycles)
3.
Oscillator shunt resistor (2 M
or open)
4.
STOP instruction (enable or disable)
5.
Low-voltage reset (enable or disable)
6.
Port A external interrupt function (enable or disable)
7.
IRQ trigger sensitivity (edge-triggered only or both edge- and level-triggered)
8.
COP watchdog (enable or disable)
SWPDI — Software Pulldown Inhibit Bit
This EPROM bit inhibits software control of the port A and port B pulldown devices.
1 = Software pulldown inhibited
0 = Software pulldown enabled
Address:
$1FF1
Bit 7
6
5
4321
Bit 0
Read:
SWPDI
DELAY
OSCRES
SWAIT
LVREN
PIRQ
LEVEL
COPEN
Write:
Reset:
Unaffected by reset
Erased:
0
00000
Figure 13-2. Mask Option Register (MOR)
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