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参数资料
| 型号： | MC68HC908QL2VP |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDIP16 |
| 封装： | PLASTIC DIP-16 |
| 文件页数： | 51/244页 |
| 文件大小： | 3228K |
| 代理商： | MC68HC908QL2VP |
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Slave LIN Interface Controller (SLIC)
Data Sheet
MC68HC908QL Family
144
Slave LIN Interface Controller (SLIC)
MOTOROLA
14.3.4 SLIC Run
This mode is entered from the SLIC disabled mode when the SLCE bit in the
SLCC2 register is set. It is entered from the SLIC wait mode whenever activity is
sensed on the LIN bus or some other MCU source wakes the CPU out of wait
mode.
It is entered from the SLIC stop mode whenever network activity is sensed or some
other MCU source wakes the CPU out of stop mode. Messages will not be received
properly until the clocks have stabilized and the CPU is also in the run mode.
14.3.5 SLIC Wait (Core Specific)
This power conserving mode is automatically entered from the run mode whenever
the CPU executes a WAIT instruction and the SLCWCM bit in the SLCC1 register
is previously cleared. In this mode, the SLIC module internal clocks continue to run.
Any activity on the LIN network will cause the SLIC module to exit SLIC wait mode
and generate an unmaskable interrupt of the CPU. This wakeup interrupt state is
reflected in the SLCSV, encoded as the highest priority interrupt. This interrupt can
be cleared by the CPU with a read of the SLCSV.
14.3.6 Wakeup from SLIC Wait with CPU in WAIT
If the CPU executes the WAIT instruction and the SLIC module enters the wait
mode (SLCWCM = 0), the clocks to the SLIC module as well as the clocks in the
MCU continue to run. Therefore, the message which wakes up the SLIC module
from WAIT and the CPU from wait mode will also be received correctly by the SLIC
module. This is because all of the required clocks continue to run in the SLIC
module in wait mode.
14.3.7 SLIC Stop (Core Specific)
This power conserving mode is automatically entered from the run mode whenever
the CPU executes a STOP instruction, or if the CPU executes a WAIT instruction
and the SLCWCM bit in the SLCC1 register is previously set. In this mode, the SLIC
internal clocks are stopped. Any activity on the network will cause the SLIC module
to exit SLIC stop mode and generate an unmaskable interrupt of the CPU. This
wakeup interrupt state is reflected in the SLCSV, encoded as the highest priority
interrupt. This interrupt can be cleared by the CPU with a read of the SLCSV.
Depending upon which low-power mode instruction the CPU executes to cause the
SLIC module to enter SLIC stop, the message which wakes up the SLIC module
(and the CPU) may or may not be received.
相关PDF资料 |
PDF描述 |
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参数描述 |
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