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参数资料
| 型号： | MC68HC908QL2VP |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDIP16 |
| 封装： | PLASTIC DIP-16 |
| 文件页数： | 92/244页 |
| 文件大小： | 3228K |
| 代理商： | MC68HC908QL2VP |
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Slave LIN Interface Controller (SLIC)
Byte Transfer Mode Operation
MC68HC908QL Family
Data Sheet
MOTOROLA
Slave LIN Interface Controller (SLIC)
181
Figure 14-29. BTM Mode Receive Byte Sampling Example
The error also comes into effect with transmitted bit times. Using the previous
example with a SLCBT value of 34, transmitted bits will appear as 34 SLIC clock
periods long. This is one SLIC clock short of the proper length. Depending on the
frequency of the SLIC clock, one period of the SLIC clock might be a large or a
small fraction of one ideal bit time. Raising the frequency of the SLIC clock will
reduce this error relative to the ideal bit time, improving the resolution of the SLIC
clock relative to the bit rate of the bus. In any case, the error is still one SLIC clock
cycle. Raising the SLIC clock frequency, however, requires programming a higher
value for SLCBT to maintain the same target bit rate.
Smaller values of SLCBT combined with higher values of the SLIC clock frequency
(smaller clock period) will give faster bit rates, but the SLIC clock period becomes
an increasingly significant portion of one bit time.
Since BTM mode does not perform any synchronization and relies on the accuracy
of the data provided by the user software to set its sample point and generate
transmitted bits, the constraint on maximum speeds is only limited to the limits
imposed by the digital filter delay and the SLIC input clock. Since the digital filter
delay cannot be less than 16 SLIC clock cycles, the fastest possible pulse which
FILTERED
RX DATA
FILTER CLOCK
UNFILTERED
RX DATA
16 FILTER CLOCKS
(
÷1 PRESCALE)
FILTER BEGINS
FILTER REACHES 0X0
FILTER BEGINS
FILTER REACHES 0XF
AND TOGGLES FILTER OUTPUT
SLIC CLOCK
(
÷1 PRESCALE)
15 SLIC CLOCKS
COUNTING UP
35 SLIC CLOCKS
COUNTING DOWN
SLIC SAMPLE POINT
(BASED ON SLCBT VALUE)
This example assumes a SLCBT value of 30 (0x1E).
IDEAL SLIC SAMPLE POINT (17 SLIC CLOCKS)
Transmitted bits will be sent out as 30 SLIC clock cycles long.
The proper closest SLCBT setting would be 34 (0x22),
which gives the ideal sample point of 17 SLIC clocks and
transmitted bits are 34 SLIC clocks long.
(
÷1 PRESCALE)
16 FILTER CLOCKS
(
÷1 PRESCALE)
(1/2 OF SLCBT VALUE)
(ACTUAL FILTERED BIT LENGTH)
相关PDF资料 |
PDF描述 |
|---|---|
| MC9S08SE8CTGE | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO16 |
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| MB90822BPMC1 | 16-BIT, MROM, 4 MHz, MICROCONTROLLER, PQFP80 |
| MB88151PNF-G-500-JN-EFE1 | 16.7 MHz, OTHER CLOCK GENERATOR, PDSO8 |
| MPC8313EVRAFFB | 32-BIT, 333 MHz, MICROPROCESSOR, PBGA516 |
相关代理商/技术参数 |
参数描述 |
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