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参数资料
| 型号： | MC68HC908QL2VP |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 2 MHz, MICROCONTROLLER, PDIP16 |
| 封装： | PLASTIC DIP-16 |
| 文件页数： | 91/244页 |
| 文件大小： | 3228K |
| 代理商： | MC68HC908QL2VP |
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Slave LIN Interface Controller (SLIC)
Data Sheet
MC68HC908QL Family
180
Slave LIN Interface Controller (SLIC)
MOTOROLA
Figure 14-28. SLCBT Value Calculation Example 4
This resolution affects the sampling accuracy of the SLIC module on receiving
bytes, but only as far as locating the sample point of each bit within a given byte.
The best sample point of the bit may be off by as much as one SLIC clock period
from the exact center of the bit, if the proper SLCBT value for the desired bit rate
is an odd number of SLIC clock periods.
Figure 14-29 shows an example of this error. In this example, the user has
additionally chosen an incorrect value of 30 SLIC clocks for the length of one bit
time, and a filter prescaler of 1. This makes little difference in the receive sampling
of this particular bit, as the sample point is still within the bit and the digital filter will
catch any noise pulses shorter than 16 filter clocks long.The ideal value of SLCBT
would be 35 SLIC clocks, but the closest available value is 34, placing the sample
point at 17 SLIC clocks into the bit.
The error in the bit time value chosen by the user in the above example will grow
throughout the byte, as the sample point for the next bit will be only 30 SLIC clock
cycles later (1 full bit time at this bit rate setting). The SLIC resynchronizes upon
every falling edge received. In a 0x00 data byte, however, there are no falling
edges after the beginning of the start bit. This means that the accumulated error of
the sampling point over the data byte with these settings could be as high as 30
SLIC clock cycles (10 bits x {2 SLIC clocks due to user error + 1 SLIC clock
resolution error}) placing it at the boundary between the last bit and the stop bit.
This could result in missampling and missing a framing error on the last bit on high
speed communications when the SLCBT count is relatively low. A properly chosen
SLCBT value would result in a maximum error of 10 SLIC clock counts over a given
byte. This is less than one filter delay time, and will not cause missampling of any
of the bits in that byte. At the falling edge of the next start bit, the SLIC will
resynchronize and any accumulated sampling error returns to 0. The sampling
error becomes even less significant at lower speeds, when higher values of SLCBT
are used to define a bit time, as the worst case bit time resolution error is still only
one SLIC clock per bit (or maximum of 10 SLIC clocks per byte).
4 CGMXCLK Period
208.008 SLIC Clock Periods
1 SLIC Clock Period
X
=
500 ns
1 Bit
1 SLIC Clock Period
=
500 ns
1 Second
9,615 Bits
=
104.004 ms
1 Bit
8,000,000 CGMXCLK Periods
1 Second
X
104.004 ms
1 Bit
Desired Bit Rate:
9.615 bps
External Crystal Frequency:
8.000 MHz
Therefore, the closest SLCBT value would be 42 SLIC clocks (SLCBT = 0x00D0).
相关PDF资料 |
PDF描述 |
|---|---|
| MC9S08SE8CTGE | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO16 |
| MC9S08SE8MWLE | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PDSO28 |
| MB90822BPMC1 | 16-BIT, MROM, 4 MHz, MICROCONTROLLER, PQFP80 |
| MB88151PNF-G-500-JN-EFE1 | 16.7 MHz, OTHER CLOCK GENERATOR, PDSO8 |
| MPC8313EVRAFFB | 32-BIT, 333 MHz, MICROPROCESSOR, PBGA516 |
相关代理商/技术参数 |
参数描述 |
|---|---|
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