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参数资料
| 型号： | MC68HC912BL16FU8 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | QFP-64 |
| 文件页数： | 128/128页 |
| 文件大小： | 3326K |
| 代理商： | MC68HC912BL16FU8 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页当前第128页
MC68HC912BL16TS/D
99
Read anytime. Write anytime.
At reset, E Clock divided by 2 is selected.
SPR[2:0] — SPI Clock (SCK) Rate Select Bits
These bits are used to specify the SPI clock rate.
Read anytime. Write has no meaning or effect.
SPIF — SPI Interrupt Request
SPIF is set after the eighth SCK cycle in a data transfer and it is cleared by reading the SP0SR register
(with SPIF set) followed by an access (read or write) to the SPI data register.
WCOL — Write Collision Status Flag
The MCU write is disabled to avoid writing over the data being transferred. No interrupt is generated
because the error status flag can be read upon completion of the transfer that was in progress at the
Pin Mode
SPC01
NOTES:
1. The serial pin control 0 bit enables bidirectional configurations.
MSTR
MISO2
2. Slave output is enabled if DDS4 = 1, SS = 0 and MSTR = 0. (#1, #3)
MOSI3
3. Master output is enabled if DDS5 = 1 and MSTR = 1. (#2, #4)
SCK4
4. SCK output is enabled if DDS6 = 1 and MSTR = 1. (#2, #4)
SS5
5. SS output is enabled if DDS7 = 1, SSOE = 1 and MSTR = 1. (#2, #4)
#1
Normal
0
Slave Out
Slave In
SCK In
SS In
#2
1
Master In
Master Out
SCK Out
SS I/O
#3
Bidirectional
1
0
Slave I/O
GPI/O
SCK In
SS In
#4
1
GPI/O
Master I/O
SCK Out
SS I/O
SP0BR — SPI Baud Rate Register
$00D2
Bit 7
6
5
4
3
2
1
Bit 0
0
SPR2
SPR1
SPR0
RESET:
0
Table 32 SPI Clock Rate Selection
SPR2
SPR1
SPR0
E Clock
Divisor
Frequency at
E Clock = 4 MHz
Frequency at
E Clock = 8 MHz
0
2
2.0 MHz
4.0 MHz
0
1
4
1.0 MHz
2.0 MHz
0
1
0
8
500 kHz
1.0 MHz
0
1
16
250 kHz
500 kHz
1
0
32
125 kHz
250 kHz
1
0
1
64
62.5 kHz
125 kHz
1
0
128
31.3 kHz
62.5 kHz
1
256
15.6 kHz
31.3 kHz
SP0SR — SPI Status Register
$00D3
Bit 7
6
5
4
3
2
1
Bit 0
SPIF
WCOL
0
MODF
0
RESET:
0
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
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PDF描述 |
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