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参数资料
| 型号： | MC92604ZT |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 116/122页 |
| 文件大小： | 0K |
| 描述： | IC TXRX ETH DUAL GIG 196-MAPBGA |
| 标准包装： | 630 |
| 类型： | 收发器 |
| 驱动器/接收器数： | 2/2 |
| 规程： | 千兆位以太网 |
| 电源电压： | 4.5 V ~ 5.5 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 196-LBGA |
| 供应商设备封装： | 196-MAPBGA（15x15） |
| 包装： | 托盘 |
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Electrical Specifications and Characteristics
MC92604 Dual Gigabit Ethernet Transceiver Reference Manual, Rev. 1
Freescale Semiconductor
7-11
7.3.3
Reference Clock Timing
The following section provides the reference clock timing for the MC92604. Figure 7-7 provides the
reference clock timing diagram.
Figure 7-7. Reference Clock Timing Diagram
Table 7-11 provides the reference clock specifications.
Table 7-11. Reference Clock Specifications
Symbol
Characteristic
Min
Max
Unit
Tr
REF_CLK_P/N rise time 1
1 Measured between 10–90 percent points.
—
2.0
ns
Tf
REF_CLK_P/N fall time 1
—
2.0
ns
frange
REF_CLK_P/N frequency range2,3
2 Measured between 50–50 percent points.
3 Full-speed operation (HSE = low).
95
135
MHz
frange
REF_CLK_P/N frequency range 2,4
4 Half-speed operation (HSE = high).
47.5
67.5
MHz
TD
REF_CLK_P/N duty cycle
45
55
%
Tdiff
REF_CLK_P to REF_CLK_N differential skew
—
1.0
ns
ftol
REF_CLK_P/N frequency tolerance
–200
200
ppm
Tj
REF_CLK_P/N input jitter 5
5 Total peak-to-peak jitter.
—
80
ps
Tlock
PLL lock time6
6 Lock time after compliant REF_CLK_P/N signal applied.
—
20,480 + 25
s
bit-times
Tf, Tr
Tdiff
REF_CLK_P
REF_CLK_N
1/frange
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