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参数资料
| 型号： | MCIMX251AJM4A |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 400 MHz, MICROPROCESSOR, PBGA400 |
| 封装： | 17 X 17 MM, 0.80 MM PITCH, ROHS COMPLIANT, PLASTIC, MAPBGA-400 |
| 文件页数： | 10/140页 |
| 文件大小： | 1416K |
| 代理商： | MCIMX251AJM4A |
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i.MX25 Applications Processor for Automotive Products, Rev. 8
Freescale Semiconductor
107
3.7.17.2
SSI Receiver Timing with Internal Clock
parameters (SS1–SS51) shown in the figure.
Figure 79. SSI Receiver Internal Clock Timing Diagram
Table 82. SSI Receiver Timing with Internal Clock
ID
Parameter
Min.
Max.
Unit
Internal Clock Operation
SS1
(Tx/Rx) CK clock period
81.4
—
ns
SS2
(Tx/Rx) CK clock high period
36.0
—
ns
SS3
(Tx/Rx) CK clock rise time
—
6.0
ns
SS4
(Tx/Rx) CK clock low period
36.0
—
ns
SS5
(Tx/Rx) CK clock fall time
—
6.0
ns
SS7
(Rx) CK high to FS (bl) high
—
15.0
ns
SS9
(Rx) CK high to FS (bl) low
—
15.0
ns
SS11
(Rx) CK high to FS (wl) high
—
15.0
ns
SS13
(Rx) CK high to FS (wl) low
—
15.0
ns
SS20
SRXD setup time before (Rx) CK low
10.0
—
ns
SS21
SRXD hold time after (Rx) CK low
0.0
—
ns
Oversampling Clock Operation
SS47
Oversampling clock period
15.04
—
ns
SS50
SS48
AUDn_TXC
AUDn_TXFS (bl)
AUDn_TXFS (wl)
AUDn_RXD
AUDn_RXC
SS1
SS4
SS2
SS51
SS20
SS21
SS49
SS7
SS9
SS11
SS13
SS47
(Output)
(Input)
(Output)
SS3
SS5
相关PDF资料 |
PDF描述 |
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