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参数资料
| 型号： | MPC5200BV400 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 42/72页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT 400MHZ 272-PBGA |
| 标准包装： | 40 |
| 系列： | MPC52xx |
| 核心处理器： | 603e G2 LE |
| 芯体尺寸： | 32-位 |
| 速度： | 400MHz |
| 连通性： | CAN，EBI/EMI，以太网，I²C，IrDA，J1850，SPI，UART/USART，USB |
| 外围设备： | AC'97，DMA，I²S，POR，PWM，WDT |
| 输入/输出数： | 56 |
| 程序存储器类型： | 外部程序存储器 |
| RAM 容量： | 16K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.42 V ~ 1.58 V |
| 振荡器型： | 内部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 272-BBGA |
| 包装： | 托盘 |
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MPC5200B Data Sheet, Rev. 4
Freescale Semiconductor
47
1.3.16
PSC
1.3.16.1
Codec Mode (8-,16-, 24-, and 32-bit)/I2S Mode
NOTE
Output timing is specified at a nominal 50 pF load.
Figure 37. Timing Diagram — 8-, 16-, 24-, and 32-bit CODEC / I2S Master Mode
Table 42. Timing Specifications—8-, 16-, 24-, and 32-bit CODEC / I2S Master Mode
Sym
Description
Min
Typ
Max
Units
SpecID
1
Bit Clock cycle time, programmed in CCS register
40.0
—
ns
A15.1
2
Clock duty cycle
—
50
—
%(1)
1 Bit Clock cycle time.
A15.2
3
Bit Clock fall time
—
7.9
ns
A15.3
4
Bit Clock rise time
—
7.9
ns
A15.4
5
FrameSync valid after clock edge
—
8.4
ns
A15.5
6
FrameSync invalid after clock edge
—
8.4
ns
A15.6
7
Output Data valid after clock edge
—
9.3
ns
A15.7
8
Input Data setup time
6.0
—
ns
A15.8
BitClk
5
3
4
3
4
(CLKPOL=0)
BitClk
(CLKPOL=1)
FrameSync
(SyncPol = 1)
TxD
Output
6
7
8
Output
FrameSync
(SyncPol = 0)
Output
RxD
Input
1
22
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