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参数资料
| 型号： | MPC8240LZU250X |
| 厂商： | MOTOROLA INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, 250 MHz, RISC PROCESSOR, PBGA352 |
| 封装： | TBGA-352 |
| 文件页数： | 10/52页 |
| 文件大小： | 542K |
| 代理商： | MPC8240LZU250X |
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18
MPC8240 (rev0.5) Hardware Specifications
PRELIMINARY—SUBJECT TO CHANGE WITHOUT NOTICE
Electrical and Thermal Characteristics
.
Figure 7. Input - Output Timing Diagram Referenced to PCI_SYNC_IN
.
Figure 8. Input Timing Diagram for Mode Select Signals
1.4.3.3 Output AC Timing Specication
Table 10 provides the processor bus AC timing specications for the MPC8240. See Figure 6 and Figure 7.
Table 10. Output AC Timing Specifications
At recommended operating conditions (See Table 2) with GVdd = 3.3 V ± 5% and LVdd = 3.3 V ± 5%
Num
Characteristic3,6
Min
Max
Units
Notes
12a
PCI_SYNC_IN to Output Valid, 66 MHz PCI, with MCP pulled-down
to logic 0 state. See Table 11.
—
6.0
ns
2,4
PCI_SYNC_IN to Output Valid, 33 MHz PCI, with MCP in the default
logic 1 state. See Table 11.
—
8.0
ns
2,4
12b1 SDRAM_SYNC_IN to Output Valid
(For Memory Control & Data Signals accessing DRAM in Flow
Through Mode)
—
7.0
ns
1
12b2 SDRAM_SYNC_IN to Output Valid
(For Memory Control & Data Signals accessing DRAM in Registered
Mode)
—
6.0
ns
1
12b3 SDRAM_SYNC_IN to Output Valid
(For Memory Control & Data Signals accessing non-DRAM)
—
7.0
ns
1
OVdd÷2
10a
11a
PCI_SYNC_IN
PCI
12a
13a
14a
OVdd÷2
0.4*OVdd
0.615*OVdd
0.285*OVdd
Input Timing
Output Timing
INPUTS/OUTPUTS
VM
VM = Midpoint Voltage (1.4V)
11b
MODE PINS
10e
HRST_CPU / HRST_CTRL
2.0 V
0.8 V
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