参数资料
型号: MPC8540VTAQFC
厂商: Freescale Semiconductor
文件页数: 12/104页
文件大小: 0K
描述: MPU POWERQUICC III 783FCPBGA
标准包装: 36
系列: MPC85xx
处理器类型: 32-位 MPC85xx PowerQUICC III
速度: 1.0GHz
电压: 1.3V
安装类型: 表面贴装
封装/外壳: 784-BBGA,FCBGA
供应商设备封装: 783-FCPBGA(29x29)
包装: 托盘
MPC8540 Integrated Processor Hardware Specifications, Rev. 4.1
Freescale Semiconductor
15
RESET Initialization
4.3 RapidIO Transmit Clock Input Timing
Table 9 provides the RapidIO transmit clock input (RIO_TX_CLK_IN) AC timing specifications for the
MPC8540.
4.4 Real Time Clock Timing
Table 10 provides the real time clock (RTC) AC timing specifications for the MPC8540.
5 RESET Initialization
This section describes the AC electrical specifications for the RESET initialization timing requirements of
the MPC8540. Table 7 provides the RESET initialization AC timing specifications for the MPC8540.
Table 9. RIO_TX_CLK_IN AC Timing Specifications
Parameter/Condition
Symbol
Min
Typical
Max
Unit
Notes
RIO_TX_CLK_IN frequency
fRCLK
125
MHz
RIO_TX_CLK_IN cycle time
tRCLK
——
8
ns
RIO_TX_CLK_IN duty cycle
tRCLKH/tRCLK
48
52
%
1
Notes:
1. Requires
±100 ppm long term frequency stability. Timing is guaranteed by design and characterization.
Table 10. RTC AC Timing Specifications
Parameter/Condition
Symbol
Min
Typical
Max
Unit
Notes
RTC clock high time
tRTCH
2 x
tCCB_CLK
——
ns
RTC clock low time
tRTCL
2 x
tCCB_CLK
——
ns
Table 11. RESET Initialization Timing Specifications
Parameter/Condition
Min
Max
Unit
Notes
Required assertion time of HRESET
100
μs
Minimum assertion time for SRESET
512
SYSCLKs
1
PLL input setup time with stable SYSCLK before
HRESET negation
100
μs
Input setup time for POR configs (other than PLL config)
with respect to negation of HRESET
4
SYSCLKs
1
Input hold time for POR configs (including PLL config)
with respect to negation of HRESET
2
SYSCLKs
1
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