参数资料
型号: MSC8122ADSE
厂商: Freescale Semiconductor
文件页数: 32/48页
文件大小: 0K
描述: KIT ADVANCED DEV SYSTEM 8122
标准包装: 1
系列: StarCore
类型: DSP
适用于相关产品: MSC8122
所含物品:
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MSC8122MP8000-ND - DSP 16BIT 500MHZ MULTI 431FCPBGA
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MSC8122TVT6400V-ND - IC DSP QUAD 16B 400MHZ 431FCPBGA
MSC8122TVT4800V-ND - IC DSP QUAD 16B 300MHZ 431FCPBGA
Electrical Characteristics
2.5.7
TDM Timing
Table 21. TDM Timing
1.1 V Core
1.2 V Core
No.
Characteristic
Expression
Units
Min
Max
Min
Max
300
301
302
303
304
305
TDMxRCLK/TDMxTCLK
TDMxRCLK/TDMxTCLK high pulse width
TDMxRCLK/TDMxTCLK low pulse width
TDM receive all input set-up time
TDM receive all input hold time
TDMxTCLK high to TDMxTDAT/TDMxRCLK output
TC 1
(0.5 ± 0.1) × TC
(0.5 ± 0.1) × TC
16
7
7
1.3
1.0
2.8
16
7
7
1.3
1.0
2.8
ns
ns
ns
ns
ns
ns
active 2,3
306
307
308
TDMxTCLK high to TDMxTDAT/TDMxRCLK output
All output hold time 4
TDMxTCLK high to TDmXTDAT/TDMxRCLK output high
2.5
10.0
10.7
2.5
8.8
10.5
ns
ns
ns
impedance 2,3
309
310
TDMxTCLK high to TDMXTSYN output valid 2
TDMxTSYN output hold time 4
2.5
9.7
2.5
8.5
ns
ns
Notes:
1.
2.
3.
4.
Values are based on a a maximum frequency of 62.5 MHz. The TDM interface supports any frequency below 62.5 MHz.
Devices operating at 300 MHz are limited to a maximum TDMxRCLK/TDMxTCLK frequency of 50 MHz.
Values are based on 20 pF capacitive load.
When configured as an output, TDMxRCLK acts as a second data link. See the MSC8122 Reference Manual for details.
Values are based on 10 pF capacitive load.
300
302
301
TDMxRCLK
304
303
TDMxRDAT
304
303
TDMxRSYN
Figure 18. TDM Inputs Signals
300
302
301
TDMxTCLK
TDMxTDAT
TDMxRCLK
306
305
309
308
307
310
TDMxTSYN
Figure 19. TDM Output Signals
MSC8122 Quad Digital Signal Processor Data Sheet, Rev. 16
32
Freescale Semiconductor
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