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参数资料
| 型号： | MT80C51-12R |
| 厂商： | TEMIC SEMICONDUCTORS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP44 |
| 文件页数： | 117/170页 |
| 文件大小： | 4133K |
| 代理商： | MT80C51-12R |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页当前第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页
50
ATtiny4/5/9/10 [DATASHEET]
8127F–AVR–02/2013
Notes:
1. EXT_CLOCK is 1 when external clock is selected as main clock.
10.4
Register Description
10.4.1
PORTCR – Port Control Register
Bits 7:2, 0 – Reserved
These bits are reserved and will always read zero.
Bit 1 – BBMB: Break-Before-Make Mode Enable
When this bit is set the Break-Before-Make mode is activated for the entire Port B. The intermediate tri-state cycle
is then inserted when writing DDRxn to make an output. For further information, see “Break-Before-Make Switch-
10.4.2
PUEB – Port B Pull-up Enable Control Register
Table 10-5.
Overriding Signals for Alternate Functions in PB1..PB0
Signal
Name
PB1/ADC1/AIN1/OC0B/CLKI/ICP0/PCINT1
PB0/ADC0/AIN0/OC0A/PCINT0
PUOE
EXT_CLOCK(1)
0
PUOV
0
DDOE
EXT_CLOCK(1)
0
DDOV
0
PVOE
EXT_CLOCK(1) + OC0B Enable
OC0A Enable
PVOV
EXT_CLOCK(1) OC0B
OC0A
PTOE
0
DIEOE
EXT_CLOCK(1) + (PCINT1 PCIE0) +
ADC1D
(PCINT0 PCIE0) + ADC0D
DIEOV
(EXT_CLOCK(1) PWR_DOWN) +
(EXT_CLOCK(1) PCINT1 PCIE0)
PCINT0 PCIE0
DI
CLOCK/ICP0/PCINT1 Input
PCINT0 Input
AIO
ADC1/Analog Comparator Negative Input
ADC0/Analog Comparator Positive Input
Bit
7
6
5
4
3
2
1
0
–
BBMB
–PORTCR
Read/Write
R
R/W
R
Initial Value
0
Bit
765
432
10
–
PUEB3
PUEB2
PUEB1
PUEB0
PUEB
Read/Write
R
R/W
Initial Value
000
00
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