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参数资料
| 型号： | MT80C51-12R |
| 厂商： | TEMIC SEMICONDUCTORS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, PQFP44 |
| 文件页数： | 143/170页 |
| 文件大小： | 4133K |
| 代理商： | MT80C51-12R |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页当前第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页
74
ATtiny4/5/9/10 [DATASHEET]
8127F–AVR–02/2013
ported by the Timer/Counter unit are: Normal mode (counter), Clear Timer on Compare match (CTC) mode, and
three types of Pulse Width Modulation (PWM) modes. (“Modes of Operation” on page 61).
11.11.2
TCCR0B – Timer/Counter0 Control Register B
Bit 7 – ICNC0: Input Capture Noise Canceler
Setting this bit (to one) activates the Input Capture Noise Canceler. When the noise canceler is activated, the input
from the Input Capture pin (ICP0) is filtered. The filter function requires four successive equal valued samples of
the ICP0 pin for changing its output. The Input Capture is therefore delayed by four oscillator cycles when the noise
canceler is enabled.
Bit 6 – ICES0: Input Capture Edge Select
This bit selects which edge on the Input Capture pin (ICP0) that is used to trigger a capture event. When the ICES0
bit is written to zero, a falling (negative) edge is used as trigger, and when the ICES0 bit is written to one, a rising
(positive) edge will trigger the capture.
When a capture is triggered according to the ICES0 setting, the counter value is copied into the Input Capture Reg-
ister (ICR0). The event will also set the Input Capture Flag (ICF0), and this can be used to cause an Input Capture
Interrupt, if this interrupt is enabled.
Table 11-5.
Waveform Generation Modes
Mode
WGM
0
3:0
Mode of Operation
TOP
Update of
OCR0
x at
TOV0 Flag
Set on
0
0000
Normal
0xFFFF
Immediate
MAX
1
0001
PWM, Phase Correct, 8-bit
0x00FF
TOP
BOTTOM
2
0010
PWM, Phase Correct, 9-bit
0x01FF
TOP
BOTTOM
3
0011
PWM, Phase Correct, 10-bit
0x03FF
TOP
BOTTOM
40100
CTC (
Clear Timer on Compare)
OCR0A
Immediate
MAX
5
0101
Fast PWM, 8-bit
0x00FF
TOP
6
0110
Fast PWM, 9-bit
0x01FF
TOP
7
0111
Fast PWM, 10-bit
0x03FF
TOP
8
1000
PWM, Phase & Freq. Correct
ICR0
BOTTOM
9
1001
PWM, Phase & Freq. Correct
OCR0A
BOTTOM
10
1010
PWM, Phase Correct
ICR0
TOP
BOTTOM
11
1011
PWM, Phase Correct
OCR0A
TOP
BOTTOM
12
1100
CTC (
Clear Timer on Compare)
ICR0
Immediate
MAX
13
1101
(Reserved)
–
14
1110
Fast PWM
ICR0
TOP
15
1111
Fast PWM
OCR0A
TOP
Bit
765
4
3
2
1
0
ICNC0
ICES0
–
WGM03
WGM02
CS02
CS01
CS00
TCCR0B
Read/Write
R/W
R
R/W
Initial Value
0
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PDF描述 |
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