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参数资料
| 型号： | PM73487 |
| 厂商： | PMC-SIERRA INC |
| 元件分类： | 数字传输电路 |
| 英文描述： | 622 Mbps ATM Traffic Management Device |
| 中文描述： | ATM/SONET/SDH SUPPORT CIRCUIT, PBGA503 |
| 封装： | EPBGA-503 |
| 文件页数： | 216/251页 |
| 文件大小： | 3126K |
| 代理商： | PM73487 |
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PM73487 QRT
PMC-Sierra, Inc.
PMC-980618
Issue 3
622 Mbps ATMTraffic Management Device
Released
Datasheet
204
10
JTAG Support
The QRT supports the IEEE Boundary Scan Specification as described in the
IEEE 1149.1 standards. The Test Access Port (TAP) consists of the five standard
pins, TRSTB, TCK, TMS, TDI and TDO, used to control the TAP controller and the
boundary scan registers. The TRSTB input is the active low reset signal used to
reset the TAP controller. TCK is the test clock used to sample data on input, TDI
and to output data on output, TDO. The TMS input is used to direct the TAP con-
troller through its states. The basic boundary scan architecture is shown below.
Figure 70.
Boundary Scan Architecture
JTAG
The boundary scan architecture consists of a TAP controller, an instruction regis-
ter with instruction decode, a bypass register, a device identification register and a
boundary scan register. The TAP controller interprets the TMS input and gener-
ates control signals to load the instruction and data registers. The instruction reg-
ister with instruction decode block is used to select the test to be executed and/or
the register to be accessed. The bypass register offers a single bit delay from pri-
Boundary Scan
Register
Control
TDI
TDO
Device Identification
Register
Bypass
Register
Instruction
Register
and
Decode
TRSTB
TMS
TCK
Test
Access
Port
Controller
Mux
DFF
Select
Tri-state Enable
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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| PM73487-PI | 制造商:PMC 制造商全称:PMC 功能描述:622 Mbps ATM Traffic Management Device |
| PM73488 | 制造商:PMC 制造商全称:PMC 功能描述:5 Gbit/s ATM Switch Fabric Element |
| PM73488PI | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Telecommunication IC |
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