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参数资料
| 型号： | R5F36B3ENNP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQCC64 |
| 封装： | 9 X 9 MM, 0.50 MM PITCH, PLASTIC, HVQFN-64 |
| 文件页数： | 339/354页 |
| 文件大小： | 4695K |
| 代理商： | R5F36B3ENNP |
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R01UH0197EJ0120 Rev.1.20
Page 66 of 331
Jul 21, 2011
M16C/6B Group
9. Interrupt
9.4.2
Relocatable Vector Tables
The 256 bytes beginning with the start address set in the INTB register comprise a relocatable vector table area.
Tables 9.2 and 9.3 list the Relocatable Vector Tables. Setting an even address in the INTB register results in the
interrupt sequence being executed faster than setting an odd address.
NOTES:
1.
Address relative to address in INTB.
2.
During I2C mode, interrupts NACK and ACK comprise the interrupt source.
3.
Use bits IFSR26 and IFSR27 in the IFSR2A register to select.
4.
These interrupts cannot be disabled using the I flag.
5.
Bus collision detection: During IE mode, this bus collision detection constitutes the interrupt source. During I2C
mode, however, a start condition or a stop condition detection constitutes the interrupt source.
Table 9.2
Relocatable Vector Table (1)
Interrupt Source
Vector Address (1)
Address (L) to Address (H)
Software
Interrupt
Number
Reference
INT instruction interrupt
+0 to +3 (0000h to 0003h) to
+252 to +255 (00FCh to 00FFh)
0 to 63
M16C/60, M16C/20, M16C/Tiny
series software manual
BRK instruction (4)
+0 to +3 (0000h to 0003h)
0
Timer B5
+20 to +23 (0014h to 0017h)
5
Timer B4, UART1 bus collision
detect (3, 5)
+24 to +27 (0018h to 001Bh)
6
Timer B3, UART0 bus collision
detect (3, 5)
+28 to +31 (001Ch to 001Fh)
7
Timer compare 0
+32 to +35 (0020h to 0023h)
8
Timer compare 1
+36 to +39 (0024h to 0027h)
9
UART2 bus collision detection (5)
+40 to +43 (0028h to 002Bh)
10
DMA0
+44 to +47 (002Ch to 002Fh)
11
DMA1
+48 to +51 (0030h to 0033h)
12
Key input interrupt
+52 to +55 (0034h to 0037h)
13
A/D (64-pin version only)
+56 to +59 (0038h to 003Bh)
14
UART2 transmit, NACK2 (2)
+60 to +63 (003Ch to 003Fh)
15
UART2 receive, ACK2 (2)
+64 to +67 (0040h to 0043h)
16
UART0 transmit, NACK0 (2)
+68 to +71 (0044h to 0047h)
17
UART0 receive, ACK0 (2)
+72 to +75 (0048h to 004Bh)
18
UART1 transmit, NACK1 (2)
+76 to +79 (004Ch to 004Fh)
19
UART1 receive, ACK1 (2)
+80 to +83 (0050h to 0053h)
20
Timer A0
+84 to +87 (0054h to 0057h)
21
Timer A1
+88 to +91 (0058h to 005Bh)
22
Timer A2
+92 to +95 (005Ch to 005Fh)
23
Timer A3
+96 to +99 (0060h to 0063h)
24
Timer A4
+100 to +103 (0064h to 0067h)
25
Timer B0
+104 to +107 (0068h to 006Bh)
26
Timer B1
+108 to +111 (006Ch to 006Fh)
27
Timer B2
+112 to +115 (0070h to 0073h)
28
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