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参数资料
| 型号： | R5F36B3ENNP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQCC64 |
| 封装： | 9 X 9 MM, 0.50 MM PITCH, PLASTIC, HVQFN-64 |
| 文件页数： | 349/354页 |
| 文件大小： | 4695K |
| 代理商： | R5F36B3ENNP |
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R01UH0197EJ0120 Rev.1.20
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Jul 21, 2011
M16C/6B Group
9. Interrupt
Figure 9.10
Interrupts Priority Select Circuit
Interrupt
request
accepted
Level 0
(initial value)
Priority of peripheral
function interrupts
(if priority levels are
same)
Interrupt request level
selection output to clock
generating circuit (Figure 7.1)
I flag
Watchdog timer
Oscillation stop and
re-oscillation detection
DBC
NMI
Address match
Low voltage detection
Higher
Lower
Timer compare 2
Timer B1
Timer A2
Timer B3, UART0
bus collision
Timer B5
UART1 receive, ACK1
Timer A4
Reception overrun 0
PLL lock detection
Address filter
Bank 0 reception complete, IDLE
CCA complete
Bank 1 reception complete, clock regulator
Transmission complete
DMA3
Priority level of each interrupt
Reception overrun 1
Transmission overrun
INT1
Timer B2
Timer B0
Timer A3
DMA2
INT0
Timer A1
Timer B4, UART1
bus collision
IPL
Priority level of each interrupt
Timer compare 0
Timer compare 1
UART2
bus collision
Timer A0
UART1 transmit, NACK1
UART0 transmit, NACK0
UART2 transmit, NACK2
Key input interrupt
DMA0
DMA1
A/D conversion (64-pin version only)
UART0 receive, ACK0
UART2 receive, ACK2
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PDF描述 |
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