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参数资料
| 型号： | R5F5630ACDFB |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144 |
| 文件页数： | 133/337页 |
| 文件大小： | 14635K |
| 代理商： | R5F5630ACDFB |
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R01UH0040EJ0100 Rev.1.00
Page 218 of 1657
Sep 8, 2011
RX630 Group
8. Voltage Detection Circuit (LVD)
8.2.4
Voltage Monitoring 2 Circuit Status Register (LVD2SR)
Note 1. Only 0 can be written to this bit. After writing 0 to this bit, it takes 2 system clock cycles for the bit to be read as 0.
LVD2DET Flag (Voltage Monitoring 2 Voltage Change Detection Flag)
The LVD2DET flag is enabled when the LVCMPCR.LVD2E bit is 1 (voltage detection 2 circuit enabled) and the
LVD2CR0.LVD2CMPE bit is 1 (voltage monitoring 2 circuit comparison result output enabled).
When LVD2CR0 and LVD2CR1 have been modified, the LVD2DET flag may become 1. In this case, the LVD2DET
flag should be set to 0 after LVD2CR0 and LVD2CR1 are modified.
The LVD2DET flag should be set to 0 after LVD2CR0.LVD2RIE is set to 0 (disabled). LVD2CR0.LVD2RIE can be set
to 1 (enabled) again after a period of two or more cycles of PCLKB has elapsed.
Depending on the number of cycles of PCLKB defined for access to read an I/O register, two or more cycles of PCLKB
may have to be secured as waiting time.
LVD2MON Flag (Voltage Monitoring 2 Signal Monitor Flag)
The LVD2MON flag is enabled when the LVCMPCR.LVD2E bit is 1 (voltage detection 2 circuit enabled) and the
LVD2CR0.LVD2CMPE bit is 1 (voltage monitoring 2 circuit comparison result output enabled).
Address(es): 0008 00E3h
b7
b6
b5
b4
b3
b2
b1
b0
——————
LVD2M
ON
LVD2D
ET
Value after reset:
00000
010
Bit
Symbol
Bit Name
Description
R/W
b0
Voltage Monitoring 2 Voltage
Change Detection Flag
0: Not detected
1: Vdet2 passage detection
R(/W)
*1
b1
Voltage Monitoring 2 Signal
Monitor Flag
0: VCC < Vdet2
1: VCC
Vdet2 or LVD2MON is disabled
R
b7 to b2
—
Reserved
These bits are read as 0. The write value should be 0.
R/W
相关PDF资料 |
PDF描述 |
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