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参数资料
| 型号： | R5F5630ACDFB |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144 |
| 文件页数： | 278/337页 |
| 文件大小： | 14635K |
| 代理商： | R5F5630ACDFB |
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R01UH0040EJ0100 Rev.1.00
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Sep 8, 2011
RX630 Group
1. Overview
1.
Overview
1.1
Outline of Specifications
Table 1.1 shows the outline of maximum specifications, and the number of peripheral module channels differs
depending on the pin number on the package and the on-chip ROM capacity. For details, see Table 1.2, Functions of
Table 1.1
Outline of Specifications (1/5)
Classification
Module/Function
Description
CPU
Maximum operating frequency: 100 MHz
32-bit RX CPU
Minimum instruction execution time: One instruction per state (cycle of the system
clock)
Address space: 4-Gbyte linear
Register set of the CPU
General purpose: Sixteen 32-bit registers
Control: Nine 32-bit registers
Accumulator: One 64-bit register
Basic instructions: 73
Floating-point operation instructions: 8
DSP instructions: 9
Addressing modes: 10
Data arrangement
Instructions: Little endian
Data: Selectable as little endian or big endian
On-chip 32-bit multiplier: 32 × 32 64 bits
On-chip divider: 32 / 32 32 bits
Barrel shifter: 32 bits
FPU
Single precision floating point (32 bits)
Data types and floating-point exceptions in conformance with the IEEE754 standard
Memory
ROM
ROM capacity: 2 Mbytes max.
Two on-board programming modes
Boot mode (The user area is programmable via the SCI and USB.)
User program mode
Parallel programmer mode (for off-board programming)
RAM
RAM capacity: 128 Kbytes
E2 data flash
Data ROM capacity: 32 Kbytes
MCU operating modes
Single-chip mode, on-chip ROM enabled expansion mode, and on-chip ROM disabled
expansion mode (software switching)
Clock
Clock generation circuit
Main clock oscillator, sub-clock oscillator, low-speed/high-speed on-chip oscillator, PLL
frequency synthesizer, and dedicated on-chip oscillator for the IWDT
Main-clock oscillation stop detection
Separate frequency-division and multiplication settings for the system clock (ICLK),
peripheral module clock (PCLK), and external bus clock (BCLK)
The CPU and other bus masters run in synchronization with the system clock (ICLK):
Up to 100 MHz
Peripheral modules run in synchronization with the peripheral module clock (PCLK):
Up to 50 MHz
Devices connected to the external bus run in synchronization with the external bus
clock (BCLK): Up to 50 MHz
Reset
Pin reset, power-on reset, voltage-monitoring reset, independent watchdog timer reset,
watchdog timer reset, deep software standby reset, and software reset
Voltage detection circuit
When the voltage on VCC passes the voltage detection level (Vdet), an internal reset or
internal interrupt is generated.
Low power
consumption
Low power
consumption facilities
Module stop function
Four low power consumption modes
Sleep mode, all-module clock stop mode, software standby mode, and deep software
standby mode
Battery backup function
相关PDF资料 |
PDF描述 |
|---|---|
| R5F5630BDDFB | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PQFP144 |
| R5F5630DCDFC | 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PQFP176 |
| R5F61634N50FPV | 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP120 |
| R5F61642N50FPV | 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP144 |
| R5F61648N50FPV | 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP144 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| R5F5630ACDFC | 制造商:RENESAS 制造商全称:Renesas Technology Corp 功能描述:Renesas MCUs |
| R5F5630ACDFP | 制造商:RENESAS 制造商全称:Renesas Technology Corp 功能描述:Renesas MCUs |
| R5F5630ACDFP#V0 | 制造商:Renesas Electronics Corporation 功能描述:MCU2 RX600 RX630-090 F630 - Trays |
| R5F5630ACDLC | 制造商:RENESAS 制造商全称:Renesas Technology Corp 功能描述:Renesas MCUs |
| R5F5630ACDLC#U0 | 制造商:Renesas Electronics Corporation 功能描述:RX630 768KB/96KB LGA177 100MHZ - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 32BIT 768KB FLASH 177LGA |
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