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参数资料
| 型号： | RD3152MMA7260Q |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 208/232页 |
| 文件大小： | 0K |
| 描述： | BOARD REF 3-AXIS ACCELEROMETER |
| 标准包装： | 1 |
| 系列： | ZSTAR |
| 传感器类型： | 加速计，3 轴 |
| 传感范围： | ±1.5g，2g，4g，6g |
| 接口： | 模拟 |
| 灵敏度： | 800、600、300 或 200 mV/g |
| 电源电压： | 2.2 V ~ 3.6 V |
| 嵌入式： | 是，MCU，8 位 |
| 已供物品： | 2 个板，电池，CD |
| 已用 IC / 零件： | MMA7260，MC68HC908JW32 |
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SIM Bus Clock Control and Generation
MC68HC908JW32 Data Sheet, Rev. 6
Freescale Semiconductor
77
6.2 SIM Bus Clock Control and Generation
The bus clock generator provides system clock signals for the CPU and peripherals on the MCU. The
system clocks are generated from an incoming clock, CGMOUT, as shown in Figure 6-3. This clock can
come from either an external oscillator or from the on-chip PLL. (See Chapter 5 Clock Generator Module
Figure 6-3. CGM Clock Signals
6.2.1 Bus Timing
In user mode, the internal bus frequency is either the oscillator output (CGMXCLK) divided by four or the
PLL output (CGMVCLK) divided by six.
$FE04
Interrupt Status Register 1
(INT1)
Read:
IF6
IF5
IF4
IF3
IF2
IF1
0
Write:
RRRRRRRR
Reset:
00000000
$FE05
Interrupt Status Register 2
(INT2)
Read:
IF14
IF13
IF12
IF11
IF10
IF9
IF8
IF7
Write:
RRRRRRRR
Reset:
00000000
$FE06
Interrupt Status Register 3
(INT3)
Read:
0000000
IF15
Write:
RRRRRRRR
Reset:
00000000
= Unimplemented
R
= Reserved
Figure 6-2. SIM I/O Register Summary
÷ 2
BUS CLOCK
GENERATORS
SYSTEM INTEGRATION MODULE
MONITOR MODE
USER MODE
SIMOSCEN
OSCILLATOR (OSC) MODULE
OSC2
OSC1
PHASE-LOCKED LOOP (PLL)
CGMRCLK
IT12
CGMOUT
SIMDIV2
PTC1
STOP MODE CLOCK
TO REST
OF MCU
IT23
TO REST
OF MCU
ENABLE SIGNALS
FROM CONFIG2
CGMXCLK
TO TBM
CGMXCLK
SIM COUNTER
相关PDF资料 |
PDF描述 |
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参数描述 |
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