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参数资料
| 型号： | RD3152MMA7260Q |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 74/232页 |
| 文件大小： | 0K |
| 描述： | BOARD REF 3-AXIS ACCELEROMETER |
| 标准包装： | 1 |
| 系列： | ZSTAR |
| 传感器类型： | 加速计，3 轴 |
| 传感范围： | ±1.5g，2g，4g，6g |
| 接口： | 模拟 |
| 灵敏度： | 800、600、300 或 200 mV/g |
| 电源电压： | 2.2 V ~ 3.6 V |
| 嵌入式： | 是，MCU，8 位 |
| 已供物品： | 2 个板，电池，CD |
| 已用 IC / 零件： | MMA7260，MC68HC908JW32 |
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PS2 Clock Generator Control and Status Registers
MC68HC908JW32 Data Sheet, Rev. 6
Freescale Semiconductor
165
PRE — Prescaler Selection
These bits select prescaler divider ratio. Reset clears this bit.
1 = Divide by 480 is selected
0 = Divide by 160 is selected
CSEL[1:0] — Clock Frequency Selection bits.
These bits selects the clock divider ratio to cater for different clock source frequency. Reset clears
these bits.
NOTE
Glitches may occur when CSEL[1:0] and PRE value can be altered while
PS2EN is set.
PS2IEN — PS2 Interrupt Mask
This read/write bit enables the periodic PS2 interrupt. Reset clears this bit.
1 = PS2 interrupt is enabled
0 = PS2 interrupt is disabled
CLKEN — Clock Output Enable bit
This read/write bit enables the open drain clock output. Reset clears this bit.
1 = Open drain clock output is enabled
0 = Open drain clock output is disabled
PS2EN — PS2 Clock Generator Module Enable
This read/write bit enables the module clock source. Reset clears this bit.
1 = Module enabled
0 = Module disabled
Table 12-1. CSEL[1:0] Divider Ratio
CSEL[1:0]
Divider Ratio
00
1
01
2
10
4
11
Not used
Table 12-2. Clock Selection Summary
BUS
Frequency
PRE
(Divider Raito)
CSEL[1:0]
(Divider Ratio)
Port Output
Frequency
8-MHz
160
4
12.5 kHz
6-MHz
480
1
12.5 kHz
4-MHz
160
2
12.5 kHz
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PDF描述 |
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