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参数资料
| 型号： | S29CL032J0JFAM020 |
| 厂商： | SPANSION LLC |
| 元件分类： | PROM |
| 英文描述： | 1M X 32 FLASH 3.3V PROM, 54 ns, PBGA80 |
| 封装： | 13 X 11 MM, 1 MM PITCH, FORTIFIED, BGA-80 |
| 文件页数： | 57/79页 |
| 文件大小： | 2994K |
| 代理商： | S29CL032J0JFAM020 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页当前第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页
60
S29CD-J & S29CL-J Flash Family
S29CD-J_CL-J_00_B3 March 30, 2009
Da ta
Sh e e t
18.4
Hardware Reset (RESET#)
Note
Not 100% tested.
Figure 18.6 RESET# Timings
Table 18.4 Hardware Reset (RESET#)
Parameter
Description
Test
Setup
All Speed
Options
Unit
JEDEC
Std.
tREADY
RESET# Pin Low (During embedded Algorithms) to Read or
Write (See Note)
Max
11
s
tREADY2
RESET# Pin Low (Not during embedded Algorithms) to Read or
Write (See Note)
Max
500
ns
tRP
RESET# Pulse Width
Max
500
ns
tRH
RESET# High time Before Read (See Note)
Min
50
ns
tRPD
RESET# Low to Standby Mode
Min
20
s
tRB
RY/BY # Recovery Time
Min
0
ns
tREADY3
RESET # Active for Bank NOT Executing Algorithm
Max
500
ns
RESET#
RY/BY#
tRP
tReady
Reset Timing to Bank NOT Executing Embedded Algorithm
tReady
CE#, OE#
tRH
CE#, OE#
Reset Timing to Bank Executing Embedded Algorithm
RESET#
tRP
tRB
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