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参数资料
| 型号： | S29GL256N80FAI010 |
| 厂商： | SPANSION LLC |
| 元件分类： | PROM |
| 英文描述： | MirrorBit Flash Family |
| 中文描述： | 16M X 16 FLASH 3V PROM, 80 ns, PBGA64 |
| 封装： | 13 X 11 MM, 1MM PITCH, FBGA-64 |
| 文件页数： | 101/110页 |
| 文件大小： | 2624K |
| 代理商： | S29GL256N80FAI010 |
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90
S29GLxxxN MirrorBitTM Flash Family
27631A4 May 13, 2004
Adva nce
Inform at i o n
AC Characteristics
Read-Only Operations–S29GL128N Only
Notes:
1. Not 100% tested.
2. CE#, OE# = VIL
3. OE# = VIL
4. See Figure 9 and Table 15 for test specifications.
5. Unless otherwise indicated, AC specifications for 80 ns and 90 ns speed options are tested with VIO = VCC = 3 V. AC
specifications for 90 ns and 100 ns speed options are tested with VIO = 1.8 V and VCC = 3.0 V.
Parameter
Description
Test Setup
Speed Options
JEDEC Std.
80
90 90 100 Unit
tAVAV
tRC Read Cycle Time
VIO = VCC = 3 V
Min
80
90
ns
VIO = 2.5 V, VCC = 3 V (Note 1)
90 100
VIO = 1.8 V, VCC = 3 V
90 100
ns
tAVQV tACC Address to Output Delay (Note 2)
VIO = VCC = 3 V
Max
80
90
ns
VIO = 2.5 V, VCC = 3 V (Note 1)
90 100
VIO = 1.8 V, VCC = 3 V
90 100
ns
tELQV
tCE Chip Enable to Output Delay (Note 3)
VIO = VCC = 3 V
Max
80
90
ns
VIO = 2.5 V, VCC = 3 V (Note 1)
90 100
VIO = 1.8 V, VCC = 3 V
90 100
ns
tPAC
C
Page Access Time
Max
25
35
ns
tGLQV
tOE Output Enable to Output Delay
Max
25
35
ns
tEHQZ
tDF Chip Enable to Output High Z (Note 1)
Max
20
ns
tGHQZ
tDF Output Enable to Output High Z (Note 1)
Max
20
ns
tAXQX
tOH
Output Hold Time From Addresses, CE#
or OE#, Whichever Occurs First
Min
0
ns
tOEH
Output Enable Hold
Time (Note 1)
Read
Min
0
ns
Toggle and
Data# Polling
Min
10
ns
tCEH
Chip Enable Hold
Time
Read
Min
35
ns
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| S29GL256N90TFIR20 | 制造商:Spansion 功能描述:Flash Mem Parallel 3.3V 256M-Bit 32M x 8/16M x 16 90ns 56-Pin TSOP Tray 制造商:Spansion 功能描述:Flash - NOR IC |
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