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参数资料
| 型号： | S3P9664-SM |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, OTPROM, 6 MHz, MICROCONTROLLER, PDSO24 |
| 封装： | 0.300 INCH, SOP-24 |
| 文件页数： | 148/148页 |
| 文件大小： | 784K |
| 代理商： | S3P9664-SM |
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TIMER 1
S3C9664/P9664 (Preliminary Spec)
11-2
T1CON is located at address E3H, Page 0, and is read/write addressable using Register addressing mode.
A reset clears T1CON to '00H'. This sets timer 1 to disable interval timer mode, selects an input clock frequency
of f
OSC/1024, and disables timer 1 interrupt. You can clear the timer 1 counter at any time during normal
operation by writing a "1" to T1CON.3.
To enable the timer 1 interrupt , you must write T1CON.2 and T1CON.1 to "1". To generate the exact time
interval, you should write T1CON.3 and .0, which cleared counter and interrupt pending bit. To detect an interrupt
pending condition, the application program polls pending bit, T1CON.0. When a "1" is detected, a timer 0
interrupt is pending. When the T1_INT sub-routine has been serviced, the pending condition must be cleared by
software by writing a "0" to the timer 1 interrupt pending bit, T1CON.0.
Timer 1 interrupt pending bit:
0 = No interrupt pending
0 = Clear pending bit (when write)
1 = Interrupt is pending
.7
.6
.5
.4
.3
.2
.1
.0
LSB
MSB
Timer 1 Control Register (T1CON)
E3H, R/W, Reset: 00H, Page 0
Timer 1 input clock selection bits:
00 = fOSC/1024
01 = fOSC/256
10 = fOSC/64
11 = fOSC/8
Not used.
Timer 1 counter clear bit:
0 = No effect
1 = Clear the timer 0 counter (when write)
Timer 1 interrupt enable bit:
0 = Disable interrupt
1 = Enable interrupt
Timer 1 count enable bit:
0 = Disable counting operation
1 = Enable counting operation
Figure 11-1. Timer 1 Control Register (T1CON)
相关PDF资料 |
PDF描述 |
|---|---|
| S3P9664-AM | 8-BIT, OTPROM, 6 MHz, MICROCONTROLLER, PDIP24 |
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| S3C9664XX-DK | 8-BIT, MROM, 6 MHz, MICROCONTROLLER, PDIP20 |
| S5964 | PCI BUS CONTROLLER, PBGA256 |
| S6A0072 | 16 X 40 DOTS DOT MAT LCD DRVR AND DSPL CTLR, UUC90 |
相关代理商/技术参数 |
参数描述 |
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