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参数资料
| 型号： | SAK-C167CR-4R33M |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 33 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | PLASTIC, MQFP-144 |
| 文件页数： | 65/89页 |
| 文件大小： | 1477K |
| 代理商： | SAK-C167CR-4R33M |
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C167CR
C167SR
Electrical Parameters
Data Sheet
66
V3.3, 2005-02
4.4
AC Parameters
4.4.1
Definition of Internal Timing
The internal operation of the C167CR is controlled by the internal CPU clock
f
CPU. Both
edges of the CPU clock can trigger internal (e.g. pipeline) or external (e.g. bus cycles)
operations.
The specification of the external timing (AC Characteristics) therefore depends on the
time between two consecutive edges of the CPU clock, called “TCL” (see Figure 10).
Figure 10
Generation Mechanisms for the CPU Clock
The CPU clock signal
f
CPU can be generated from the oscillator clock signal fOSC via
different mechanisms. The duration of TCLs and their variation (and also the derived
external timing) depends on the used mechanism to generate
f
CPU. This influence must
be regarded when calculating the timings for the C167CR.
Note: The example for PLL operation shown in the fig. above refers to a PLL factor of 4.
The used mechanism to generate the basic CPU clock is selected by bitfield CLKCFG
in register RP0H.7-5.
Upon a long hardware reset register RP0H is loaded with the logic levels present on the
MCT04338
f
OSC
f
CPU
Phase Locked Loop Operation
TCL
f
OSC
f
CPU
Direct Clock Drive
f
OSC
f
CPU
Prescaler Operation
TCL
相关PDF资料 |
PDF描述 |
|---|---|
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| SAK-C868P-1SRBA | 8-BIT, 40 MHz, MICROCONTROLLER, PDSO38 |
相关代理商/技术参数 |
参数描述 |
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