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参数资料
| 型号： | SAK-C167CR-4R33M |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 33 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | PLASTIC, MQFP-144 |
| 文件页数： | 70/89页 |
| 文件大小： | 1477K |
| 代理商： | SAK-C167CR-4R33M |
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C167CR
C167SR
Electrical Parameters
Data Sheet
70
V3.3, 2005-02
4.4.2
External Clock Drive XTAL1
Figure 12
External Clock Drive XTAL1
Note: If the on-chip oscillator is used together with a crystal, the oscillator frequency is
limited to a range of 4 MHz to 40 MHz.
It is strongly recommended to measure the oscillation allowance (or margin) in the
final target system (layout) to determine the optimum parameters for the oscillator
operation. Please refer to the limits specified by the crystal supplier.
When driven by an external clock signal it will accept the specified frequency
range. Operation at lower input frequencies is possible but is guaranteed by
design only (not 100% tested).
Table 16
External Clock Drive Characteristics (Operating Conditions apply)
Parameter
Symbol
Direct Drive
1:1
Prescaler
2:1
PLL
1:N
Unit
Min.
Max.
Min.
Max.
Min.
Max.
Oscillator period
t
OSC
SR
30
–
15
–
451)
1) The minimum and maximum oscillator periods for PLL operation depend on the selected CPU clock
generation mode. Please see respective table above.
5001)
ns
High time2)
2) The clock input signal must reach the defined levels
VIL2 and VIH2.
t
1
SR
153)
3) The minimum high and low time refers to a duty cycle of 50%. The maximum operating frequency (
fCPU) in
direct drive mode depends on the duty cycle of the clock input signal.
–5–10
–
ns
Low time2)
t
2
SR
–5–10
–
ns
Rise time2)
t
3
SR
–8–5–10
ns
Fall time2)
t
4
SR
–8–5–10
ns
MCT02534
3
t
4
t
VIH2
VIL
V
DD
0.5
1
t
2
t
OSC
t
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