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参数资料
| 型号： | SAK-C167CR-4R33M |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 33 MHz, MICROCONTROLLER, PQFP144 |
| 封装： | PLASTIC, MQFP-144 |
| 文件页数： | 72/89页 |
| 文件大小： | 1477K |
| 代理商： | SAK-C167CR-4R33M |
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C167CR
C167SR
Electrical Parameters
Data Sheet
72
V3.3, 2005-02
4.4.4
External Bus Timing
Figure 15
CLKOUT Signal Timing
Variable Memory Cycles
The bus timing shown below is programmable via the BUSCONx registers. The duration
of ALE and two types of waitstates can be selected. This table summarizes the possible
bus cycle durations.
Table 17
CLKOUT Reference Signal
Parameter
Symbol
Limits
Unit
Min.
Max.
CLKOUT cycle time
tc
5
CC
301)
1) The CLKOUT cycle time is influenced by the PLL jitter.
For a single CLKOUT cycle (2 TCL) the deviation caused by the PLL jitter is below 1 ns (for
fCPU > 25 MHz).
For longer periods the relative deviation decreases (see PLL deviation formula).
ns
CLKOUT high time
tc
6
CC
8
–
ns
CLKOUT low time
tc
7
CC
6
–
ns
CLKOUT rise time
tc
8
CC
–
4
ns
CLKOUT fall time
tc
9
CC
–
4
ns
Table 18
Variable Memory Cycles
Bus Cycle Type
Bus Cycle Duration
Unit
25/33 MHz, 0 Waitstates
Demultiplexed bus cycle
with normal ALE
4 + 2
× (15 - <MCTC>)
+ 2
× (1 - <MTTC>)
TCL
80 ns/60.6 ns
Demultiplexed bus cycle
with extended ALE
6 + 2
× (15 - <MCTC>)
+ 2
× (1 - <MTTC>)
TCL
120 ns/90.9 ns
Multiplexed bus cycle with
normal ALE
6 + 2
× (15 - <MCTC>)
+ 2
× (1 - <MTTC>)
TCL
120 ns/90.9 ns
Multiplexed bus cycle with
extended ALE
8 + 2
× (15 - <MCTC>)
+ 2
× (1 - <MTTC>)
TCL
160 ns/121.2 ns
MCT04415
CLKOUT
tc
5
tc
6
7
tc
8
tc
9
tc
相关PDF资料 |
PDF描述 |
|---|---|
| SAB-C167CR-L33M | 16-BIT, MROM, 33 MHz, MICROCONTROLLER, PQFP144 |
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相关代理商/技术参数 |
参数描述 |
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