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参数资料
| 型号： | SAK-XC2237M-104F40L |
| 厂商： | Infineon Technologies |
| 文件页数： | 105/107页 |
| 文件大小： | 0K |
| 描述： | IC MCU 16BIT 320KB FLASH 64LQFP |
| 标准包装： | 1,900 |
| 系列： | XC22xxM |
| 核心处理器： | C166SV2 |
| 芯体尺寸： | 16/32-位 |
| 速度： | 40MHz |
| 连通性： | CAN，EBI/EMI，I²C，LIN，SPI，SSC，UART/USART，USI |
| 外围设备： | I²S，POR，PWM，WDT |
| 输入/输出数： | 38 |
| 程序存储器容量： | 832KB（832K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 50K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 数据转换器： | A/D 9x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 64-LQFP |
| 包装： | 带卷 (TR) |
| 其它名称： | SP000720382 |
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XC2238M, XC2237M
XC2000 Family / Base Line
Electrical Parameters
Data Sheet
97
V2.1, 2011-07
4.6.6
Debug Interface Timing
The debugger can communicate with the XC223xM either via the 2-pin DAP interface or
via the standard JTAG interface.
Debug via DAP
The following parameters are applicable for communication through the DAP debug
interface.
Note: These parameters are not subject to production test but verified by design and/or
characterization.
Note: Operating Conditions apply;
C
L=20 pF.
Table 32
DAP Interface Timing for Upper Voltage Range
Parameter
Symbol
Values
Unit
Note /
Test Condition
Min.
Typ.
Max.
DAP0 clock period
t
11 SR
25
1)
1) The debug interface cannot operate faster than the overall system, therefore
t
11 ≥ tSYS.
ns
DAP0 high time
t
12 SR
8
ns
DAP0 low time
t
13 SR
8
ns
DAP0 clock rise time
t
14 SR
4ns
DAP0 clock fall time
t
15 SR
4ns
DAP1 setup to DAP0
rising edge
t
16 SR
6
ns
pad_type= stan
dard
DAP1 hold after DAP0
rising edge
t
17 SR
6
ns
pad_type= stan
dard
DAP1 valid per DAP0
clock period
2)
2) The Host has to find a suitable sampling point by analyzing the sync telegram response.
t
19 CC
17
20
ns
pad_type= stan
dard
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